[发明专利]一种测试单包正则匹配逻辑的系统和方法有效
| 申请号： | 201110415255.0 | 申请日： | 2011-12-13 |
| 公开（公告）号： | CN102495778A | 公开（公告）日： | 2012-06-13 |
| 发明（设计）人： | 纪奎;白宗元;李锋伟;张磊;邵宗有 | 申请（专利权）人： | 曙光信息产业（北京）有限公司 |
| 主分类号： | G06F11/25 | 分类号： | G06F11/25 |
| 代理公司： | 北京安博达知识产权代理有限公司 11271 | 代理人： | 徐国文 |
| 地址： | 100084 *** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供一种测试单包正则匹配逻辑的方法，PCIe仿真模型模拟PCIe总线特性，接收主机命令包括写命令和读命令。与现有技术相比，本发明的有益效果在于：1)采用SystemVerilog语言编写的程序效率很高，可以用较少的代码行数实现比较复杂的功能，提高了验证的效率。2)使用SystemVerilog基于约束的随机模拟验证是一种高效的功能验证方法，可以大大提高功能验证效率，使产品上市无功能缺陷。 | ||
| 搜索关键词： | 一种 测试 正则 匹配 逻辑 系统 方法 | ||
【主权项】：
一种测试单包正则匹配逻辑的系统，包括激励产生器、被测逻辑、参考模型、响应分析器，其特征在于，激励产生器对被测逻辑、参考模型产生相同的带约束的随机报文，响应分析器接收并比较被测逻辑和所述参考模型输出。
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