[发明专利]一种高效读取的串行Flash缓冲器控制电路有效
| 申请号： | 201110453419.9 | 申请日： | 2011-12-30 |
| 公开（公告）号： | CN102543187A | 公开（公告）日： | 2012-07-04 |
| 发明（设计）人： | 吴加兴 | 申请（专利权）人： | 东莞市泰斗微电子科技有限公司 |
| 主分类号： | G11C16/06 | 分类号： | G11C16/06;G11C16/08 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 523808 广东省东莞市松山湖高新*** | 国省代码： | 广东;44 |
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| 摘要： | 一种高效读取的串行Flash缓冲器控制电路，包括缓冲器模块，用于Flash数据的预读取和缓存，所述控制电路还包括：地址命中算法逻辑模块，用于判断处理器访问的数据是否存在于缓冲器模块内；数据有效算法逻辑模块，用于判断缓冲器模块中数据是否有效。采用本发明的技术方案后，解决传统串行Flash访问效率不高，难以直接运行代码的问题，且节省了RAM和Pad额外的开销，从而降低了芯片设计成本。 | ||
| 搜索关键词： | 一种 高效 读取 串行 flash 缓冲器 控制电路 | ||
【主权项】：
一种高效读取的串行Flash缓冲器控制电路，包括缓冲器模块，用于Flash数据的预读取和缓存，其特征在于，所述控制电路还包括：地址命中算法逻辑模块，用于判断处理器访问的数据是否存在于缓冲器模块内；数据有效算法逻辑模块，用于判断缓冲器模块中数据是否有效。
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