[发明专利]用于时钟信号生成的系统及方法有效
申请号: | 201180070248.X | 申请日: | 2011-04-20 |
公开(公告)号: | CN103493376B | 公开(公告)日: | 2016-11-16 |
发明(设计)人: | 胡贝特·博德 | 申请(专利权)人: | 飞思卡尔半导体公司 |
主分类号: | H03L7/183 | 分类号: | H03L7/183;H03L7/099 |
代理公司: | 中原信达知识产权代理有限责任公司 11219 | 代理人: | 李佳;穆德骏 |
地址: | 美国,*** | 国省代码: | 美国;US |
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摘要: | 时钟信号生成系统(10)包括被布置成提供具有可选择的第一时钟速率的第一时钟信号的时钟信号生成电路(12);被连接用于接收所述第一时钟信号并且被布置成根据分配因子生成从所述第一时钟信号生成具有恒定的时钟速率并且与所述第一时钟信号同步第二时钟信号的分配器电路(14);以及当不同的第一时钟速率被选择的时候被连接到所述分配器电路并且被布置成改变所述分配因子以保持所述第二时钟速率恒定并且所述第二时钟信号与所述第一时钟信号同步控制器模块(16)。 | ||
搜索关键词: | 用于 时钟 信号 生成 系统 方法 | ||
【主权项】:
一种时钟信号生成系统(10),包括:时钟信号生成电路(12),所述时钟信号生成电路(12)被布置成提供第一时钟信号,所述第一时钟信号具有可选择的第一时钟速率;分配器电路(14),所述分配器电路(14)被连接用于接收所述第一时钟信号,并且被布置成:根据分配因子,从所述第一时钟信号来生成第二时钟信号,所述第二时钟信号具有恒定的第二时钟速率并且与所述第一时钟信号同步;以及控制器模块(16),所述控制器模块(16)被连接到所述时钟信号生成电路并且被布置成选择所述第一时钟速率,以及所述控制器模块(16)进一步被连接到所述分配器电路,并且被布置成:在不同的第一时钟速率被选择的时候,改变所述分配因子,以保持所述第二时钟速率恒定以及所述第二时钟信号与所述第一时钟信号的同步。
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