[发明专利]高速存储区的访问方法以及访问装置有效
| 申请号： | 201210107339.2 | 申请日： | 2012-04-12 |
| 公开（公告）号： | CN103377141B | 公开（公告）日： | 2016-10-12 |
| 发明（设计）人： | 高剑刚;许勇;唐勇;李媛;张清波;郑方;高红光 | 申请（专利权）人： | 无锡江南计算技术研究所 |
| 主分类号： | G06F12/0802 | 分类号： | G06F12/0802 |
| 代理公司： | 北京集佳知识产权代理有限公司 11227 | 代理人： | 骆苏华 |
| 地址： | 214083 江苏*** | 国省代码： | 江苏;32 |
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| 摘要： | 一种高速存储区的访问方法及访问装置，其中所述访问方法包括：在处理器核心请求访问主存时，基于所述Cache数据在主存首地址、Cache行数据量、Cache行条目总数和Cache行有效位判断请求主存地址是否命中Cache；若所述请求主存地址命中Cache，则基于所述Cache数据在局部存储器首地址确定与所述请求主存地址对应的局部存储器地址，并基于所述局部存储器地址加载Cache数据；若所述请求主存地址未命中Cache，则基于所述不命中入口跳转至不命中处理例程。本技术方案简化了高速存储区的逻辑设计开销，提高了处理器的易编程性和适应性。 | ||
| 搜索关键词： | 高速 存储 访问 方法 以及 装置 | ||
【主权项】：
一种高速存储区的访问方法，所述高速存储区包括局部存储器，其特征在于，所述局部存储器存储有Cache数据和描述符，所述描述符包括Cache数据在主存首地址、Cache数据在局部存储器首地址、Cache行数据量、Cache行条目总数、Cache行有效位和不命中入口，所述访问方法包括：在处理器核心请求访问主存时，基于所述Cache数据在主存首地址、Cache行数据量、Cache行条目总数和Cache行有效位判断请求主存地址是否命中Cache；若所述请求主存地址命中Cache，则基于所述Cache数据在局部存储器首地址确定与所述请求主存地址对应的局部存储器地址，并基于所述局部存储器地址加载Cache数据；若所述请求主存地址未命中Cache，则基于所述不命中入口跳转至不命中处理例程；其中，所述不命中处理例程包括：基于所述Cache行数据量和Cache行条目总数，确定与所述请求主存地址对应的Cache行条目号；基于与所述请求主存地址对应的Cache行条目号和所述Cache行数据量确定所述请求主存地址在局部存储器中对应Cache行的起始偏移地址；根据所述Cache数据在局部存储器首地址以及所述起始偏移地址确定与所述请求主存地址对应Cache行的局部存储器起始地址；基于与所述请求主存地址对应Cache行的局部存储器起始地址，将主存中对应于所述请求主存地址对应Cache行的数据装填至所述局部存储器中；在数据装填完成后，修改所述描述符中的Cache行有效位。
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