[发明专利]乘法器有效
申请号: | 201210109337.7 | 申请日: | 2012-04-13 |
公开(公告)号: | CN102662624A | 公开(公告)日: | 2012-09-12 |
发明(设计)人: | 王勇 | 申请(专利权)人: | 钜泉光电科技(上海)股份有限公司 |
主分类号: | G06F7/523 | 分类号: | G06F7/523 |
代理公司: | 上海光华专利事务所 31219 | 代理人: | 李仪萍 |
地址: | 201203 上海市浦东新区*** | 国省代码: | 上海;31 |
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摘要: | 本发明提供一种应用于电力线载波通信系统中、基于Radix-4Booth编码的乘法器,包括:比特位选取单元、Booth编码单元、部分积累加值选通单元、加法单元、寄存单元、以及时钟控制单元;相较于现有技术,本发明充分利用了电力线载波系统中调制解调电路实现的特点,并且合理运用改进的Radix-4booth编码降低部分积个数,大大降低了乘法器的面积。 | ||
搜索关键词: | 乘法器 | ||
【主权项】:
一种基于Radix‑4 Booth编码的乘法器,应用于电力线载波通信系统中,其特征在于,所述乘法器包括:比特位选取单元、Booth编码单元、部分积累加值选通单元、加法单元、寄存单元、以及时钟控制单元;所述时钟控制单元用于产生分别控制所述比特位选取单元、所述部分积累加值选通单元以及所述寄存单元的第一时钟控制信号、第二时钟控制信号以及第三时钟控制信号;所述比特位选取单元用于基于Radix‑4 Booth编码对乘数的比特位进行选取;在所述Radix‑4 Booth编码中,在每一个时钟内每一次选取乘数中相邻的三个比特位,且相邻两次选取的三个比特位中有一个比特位是重叠的;所述乘数具有N比特位;所述Booth编码单元用于将所述比特位选取单元选取的乘数的比特位与被乘数进行相乘以获得对应的部分积;所述被乘数具有N比特位;所述部分积累加值选通单元用于从初始值和所述寄存单元寄存的前一次的部分积累加值中选择其中之一予以输出;所述部分积累加值选通单元选择前一次的部分积累加值是选取的前一次的部分积累加值的高N比特位;所述加法单元用于将所述Booth编码单元输出的部分积与所述部分积累加值选通单元输出的选通值相加以得到当前次的部分积累加值;所述寄存单元用于将所述加法单元得到的当前次的部分积累加值予以寄存,并将当前次的部分积累加值延时后输出至所述部分积累加值选通单元,以供进行下一次的部分积累加。
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