[发明专利]雷达成像信号模拟器无效
申请号: | 201210120021.8 | 申请日: | 2012-04-23 |
公开(公告)号: | CN102645647A | 公开(公告)日: | 2012-08-22 |
发明(设计)人: | 全英汇;刘培生;邢孟道;李亚超;李庆;安海磊 | 申请(专利权)人: | 西安电子科技大学 |
主分类号: | G01S7/40 | 分类号: | G01S7/40 |
代理公司: | 陕西电子工业专利中心 61205 | 代理人: | 王品华;朱红星 |
地址: | 710071*** | 国省代码: | 陕西;61 |
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摘要: | 本发明公开了一种雷达成像信号模拟器,主要解决传统模拟器的存储量小,传输速率低的问题。它包括高速大容量存储子系统、AD采集子系统和DA回放子系统,这三个子系统插接在带主板的工控机机箱内。工控机分别给大容量存储子系统和AD采集子系统发送命令,大容量存储子系统解析命令,将已存储好的雷达回波数据按雷达参数传输给DA回放子系统;在雷达触发信号和采样时钟信号到来时DA回放子系统将回放波形输送给AD采集子系统,同时AD采集子系统解析命令,采集回波信号并传输给信号处理系统,信号处理系统将处理好的数据发给工控机界面完成成像。本发明具有稳定可靠、存储量大、传输速率高及易扩展的优点,可应用于雷达、图像处理等领域。 | ||
搜索关键词: | 雷达 成像 信号 模拟器 | ||
【主权项】:
一种雷达成像信号模拟器,包括:带主板的工控机机箱(1)、高速大容量存储子系统(3)和AD采集子系统(4),其特征在于,还包括DA回放子系统(2),用于对雷达回波信号进行回放处理;所述的高速大容量存储子系统(3),包含第一大规模逻辑阵列FPGA1芯片、第一PCI1芯片、两个高速差分接口和136个存储芯片FLASH,这些FLASH分为四组,每组FLASH分别与第一FPGA1连接,第一FPGA1通过第一PCI1芯片接收工控机的命令并解析命令,通过第一高速差分接口LVDS1接收AD采集子系统采集的雷达回波数字信号,并进行存储,同时通过第二高速差分接口LVDS2向DA回放子系统发送存储的回波信号;所述的AD采集子系统(4),包含双通道AD采集芯片、第二FPGA2芯片、第二PCI2芯片、两个高速差分接口和三个信号接口通道,AD采集芯片与第二FPGA2芯片之间互联,第二FPGA2芯片通过第二PCI2芯片接收工控机的命令并解析命令,通过第三高速差分接口LVDS3和第四高速差分接口LVDS4向高速大容量存储子系统(3)及外部的信号处理系统发送采集的雷达回波数据,通过第一信号接口通道SMA1接收外界触发信号,并通过第二信号接口通道SMA2和第三信号接口通道SMA3接收DA回放子系统发送的模拟回波;所述的DA回放子系统(2),包含两片单通道DA芯片、第三FPGA3芯片,第五高速差分接口LVDS5和三个信号接口通道,该两片单通道DA芯片分别与第三FPGA3芯片之间互联,第三FPGA3芯片通过第五高速差分接口LVDS5接收高速大容量存储子系统(3)发送的数据,通过第四信号接口通道SMA4接收外界触发信号,并通过第五信号接口通道SMA5和第六信号接口通道SMA6分别向AD采集子系统(4)的第二信号接口通道SMA2和第三信号接口通道SMA3发送模拟回波信号。
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