[发明专利]双应力氮化硅蚀刻阻挡层形成方法和半导体器件制造方法有效
| 申请号： | 201210208909.7 | 申请日： | 2012-06-21 |
| 公开（公告）号： | CN102709179A | 公开（公告）日： | 2012-10-03 |
| 发明（设计）人： | 徐强 | 申请（专利权）人： | 上海华力微电子有限公司 |
| 主分类号： | H01L21/318 | 分类号： | H01L21/318;H01L21/8238 |
| 代理公司： | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人： | 陆花 |
| 地址： | 201203 上海市浦*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供了一种双应力氮化硅蚀刻阻挡层形成方法和半导体器件制造方法。根据本发明的双应力氮化硅蚀刻阻挡层形成方法包括：提供具有NMOS晶体管和PMOS晶体管的半导体器件，并且在所述半导体器件上方形成拉应力层；随后，利用第一光刻胶层将NMOS晶体管上方的拉应力层遮蔽，暴露出PMOS晶体管的拉应力层；随后，去除PMOS晶体管上方的拉应力层；随后，去除第一光刻胶层；在去除第一光刻胶层之后对所述拉应力氮化硅层进行紫外光照射；之后，在所述半导体器上方形成压应力层；此后，利用第二光刻胶层将PMOS晶体管上方的压应力层遮蔽，暴露出NMOS晶体管上方的压应力层；然后，去除NMOS晶体管上方的压应力层；随后，去除第二光刻胶层。 | ||
| 搜索关键词： | 应力 氮化 蚀刻 阻挡 形成 方法 半导体器件 制造 | ||
【主权项】：
一种双应力氮化硅蚀刻阻挡层形成方法，其特征在于包括：提供具有NMOS晶体管和PMOS晶体管的半导体器件，并且在所述半导体器件上方形成拉应力层；随后，利用第一光刻胶层将NMOS晶体管上方的拉应力层遮蔽，暴露出PMOS晶体管的拉应力层；随后，去除PMOS晶体管上方的拉应力层；随后，去除第一光刻胶层；在去除第一光刻胶层之后对所述拉应力氮化硅层进行紫外光照射；之后，在所述半导体器上方形成压应力层；此后，利用第二光刻胶层将PMOS晶体管上方的压应力层遮蔽，暴露出NMOS晶体管上方的压应力层；然后，去除NMOS晶体管上方的压应力层；此后，去除第二光刻胶层。
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H01 基本电气元件
H01L 半导体器件；其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置；专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理；集成电路器件或其特殊部件的制造
H01L 半导体器件；其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置；专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理；集成电路器件或其特殊部件的制造
