[发明专利]基于FPGA的串行通信分配装置及通信方法无效
| 申请号： | 201210347261.1 | 申请日： | 2012-09-19 |
| 公开（公告）号： | CN102915010A | 公开（公告）日： | 2013-02-06 |
| 发明（设计）人： | 丁鉴彬;徐玉惠 | 申请（专利权）人： | 山东神戎电子股份有限公司 |
| 主分类号： | G05B19/418 | 分类号： | G05B19/418 |
| 代理公司： | 济南泉城专利商标事务所 37218 | 代理人： | 李桂存 |
| 地址： | 250101 山东省济南市高新开*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明的基于FPGA的串行通信分配装置，串行通信分配装置由FPGA芯片构成，特征在于：FPGA芯片的引脚被设置为可与上位机、控制设备相连接的多个通讯端口，FPGA芯片内设置有均与通讯端口数目相等的波特率发生器、接收数据缓冲区、状态寄存器、发送数据缓冲区、控制寄存器、接收控制器和发送控制器，波特率发生器实现不同速率下数据的收发；状态寄存器中包含接收中断标志位RI、发送中断标志位TI；FPGA芯片内还设置有将不同的通讯端口连通的多路模拟开关。本发明的通信分配装置，实现了上位机与多个控制设备之间的相互通讯，可进行不同速率下数据的收发。整个装置简单、实用、可靠、稳定，成本低廉，易于实现，适合多种场合、多个节点的串行通信使用。 | ||
| 搜索关键词： | 基于 fpga 串行 通信 分配 装置 方法 | ||
【主权项】：
一种基于FPGA的串行通信分配装置，串行通信分配装置由FPGA芯片构成，其特征在于：所述FPGA芯片的引脚被设置为可与上位机（11）、控制设备（12）相连接的多个通讯端口（13），FPGA芯片内设置有均与通讯端口数目相等的波特率发生器（1）、接收数据缓冲区（2）、状态寄存器（3）、发送数据缓冲区（4）、控制寄存器（5）、接收控制器（6）和发送控制器（7），波特率发生器实现不同速率下数据的收发；接收控制器用于取出接收数据缓冲区内的数据，发送控制器用于将发送数据缓冲区内的数据发出，状态寄存器中包含接收中断标志位RI、发送中断标志位TI；FPGA芯片内还设置有将不同的通讯端口连通的多路模拟开关（8）。
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