[发明专利]循环右移累加基的深空通信中LDPC编码器和编码方法有效
申请号: | 201210374708.4 | 申请日: | 2012-09-27 |
公开(公告)号: | CN102857240A | 公开(公告)日: | 2013-01-02 |
发明(设计)人: | 张鹏;蔡超时;万欣 | 申请(专利权)人: | 苏州威士达信息科技有限公司 |
主分类号: | H03M13/11 | 分类号: | H03M13/11 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 215163 江苏省苏州市高*** | 国省代码: | 江苏;32 |
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摘要: | 本发明涉及一种CCSDS深空通信系统中9种QC-LDPC码编码的方案,其特征在于,所述系统的QC-LDPC码的编码器是基于循环右移累加机制,主要由控制器、向量存储器、循环右移表、循环右移累加器、串行循环左移累加器和差分器六部分组成。本发明提供的编码方法过程简单,步骤一致性强,易于实现。本发明提供的QC-LDPC编码器兼容多码率,能在明显提高编码速度的同时有效减少资源需求,具有易于实现、编码速度快、资源消耗少、功耗小、成本低等优点。 | ||
搜索关键词: | 循环 累加 通信 ldpc 编码器 编码 方法 | ||
【主权项】:
一种适合于CCSDS深空通信系统采用的9种QC‑LDPC码的编码器,QC‑LDPC码的校验矩阵H是由c×t个b×b阶循环矩阵构成的阵列,其中,c、t和b皆为正整数,t=a+c,3种不同码率η分别是1/2、2/3、4/5,7种方阵阶数b分别是32、64、128、256、512、1024、2048,9种有效组合(η,b)分别是(4/5,32)、(2/3,64)、(1/2,128)、(4/5,128)、(2/3,256)、(1/2,512)、(4/5,512)、(2/3,1024)和(1/2,2048),对于这9种QC‑LDPC码,均有c=12,c=3u,u=4,3种不同码率对应的参数a分别是8、16、32,3种不同码率对应的参数t分别是20、28、44,校验矩阵H对应码字v=(s,p)=(s,px,py,pz),H的前a块列对应的是信息向量s,后c块列对应的是校验向量p,以b比特为一段,信息向量s被等分为a段,即s=(s1,s2,…,sa),校验向量p被等分为c段,即p=(p1,p2,…,pc),px=(p1,p2,p3,p4),py=(p5,p6,p7,p8),pz=(p9,p10,p11,p12),其特征在于,所述编码器包括以下部件:控制器,控制信息向量的输入、码字的输出和其它部件的运行;向量存储器,用于存储向量q和码字v=(ν1,v2,…,vt),其空间用v的码段v1~vt来标识;循环右移表,用于存储矩阵Hzero中所有循环矩阵的循环右移位数和所在的块列号;循环右移累加器,用于计算向量q和部分校验向量pz;串行循环左移累加器,用于计算部分校验向量py;差分器,用于计算部分校验向量px。
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