[发明专利]一种垂直沟道型三维半导体存储器件及其制备方法在审
申请号: | 201210539211.3 | 申请日: | 2012-12-13 |
公开(公告)号: | CN103872055A | 公开(公告)日: | 2014-06-18 |
发明(设计)人: | 霍宗亮;刘明 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | H01L27/115 | 分类号: | H01L27/115;H01L29/10;H01L21/8247 |
代理公司: | 中科专利商标代理有限责任公司 11021 | 代理人: | 任岩 |
地址: | 100083 *** | 国省代码: | 北京;11 |
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摘要: | 本发明公开了一种垂直沟道型三维半导体存储器件及其制备方法,该三维半导体存储器件包括:衬底;在该衬底上依次交替淀积绝缘层和电极材料层形成的多层膜结构;刻蚀该多层膜结构至该衬底形成的多个通孔;在该多个通孔内壁依次淀积阻挡层、存储层和隧穿层形成的多个栅堆栈;在该多个栅堆栈的隧穿层表面淀积沟道材料而形成的多个空心沟道;在该空心沟道上方位线连接用接触孔接触区形成的漏级;以及在该空心沟道下方通孔与衬底接触区形成的源极。本发明有效地克服了传统多晶硅沟道低载流子迁移率所带来的小的开态沟道电流的技术难题,并提高了垂直向各存储单元存储性能的一致性和可靠性,降低了垂直沟道的制造难度和成本。 | ||
搜索关键词: | 一种 垂直 沟道 三维 半导体 存储 器件 及其 制备 方法 | ||
【主权项】:
一种垂直沟道型三维半导体存储器件,其特征在于,包括:一衬底;在该衬底上依次交替淀积绝缘层和电极材料层形成的多层膜结构;刻蚀该多层膜结构至该衬底形成的多个通孔,该通孔用以定义出沟道区域;在该多个通孔内壁依次淀积阻挡层、存储层和隧穿层形成的多个栅堆栈;在该多个栅堆栈的隧穿层表面淀积沟道材料而形成的多个空心沟道;在该空心沟道上方位线连接用接触孔接触区形成的漏级;以及在该空心沟道下方通孔与衬底接触区形成的源极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
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