[实用新型]高清编解码器时间延迟的测试装置有效

专利信息
申请号: 201220017426.4 申请日: 2012-01-13
公开(公告)号: CN202406239U 公开(公告)日: 2012-08-29
发明(设计)人: 李全才 申请(专利权)人: 深圳市中帝威科技有限公司
主分类号: H04N17/00 分类号: H04N17/00
代理公司: 暂无信息 代理人: 暂无信息
地址: 518000 广东省深圳市*** 国省代码: 广东;44
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摘要: 实用新型公开了一种高清编解码器时间延迟的测试装置,该装置包括视频信号发生器、时间计数发生器、视频叠加模块、编码器、解码器和双通道显示器,视频信号发生器和时间计数发生器分别与视频叠加模块的输入端连接,视频叠加模块的第一输出端通过编码器及解码器与双通道显示器的第一输入端连接,视频叠加模块的第二输出端与双通道显示器的第二输入端连接。本实用新型通过双通道显示器接收两路信号,一路是经过编码和解码的带有时间信息的视频信号,另一路是原始的带有时间信息的视频信号,通过双通道显示,可以直观地得到两个视频信号显示的时间值,通过简单的差值计算,就可以准确而直观地得到实际的编解码信号的延迟时间。
搜索关键词: 编解码器 时间 延迟 测试 装置
【主权项】:
一种高清编解码器时间延迟的测试装置,其特征在于,包括用于产生标准视频信号的视频信号发生器、用于产生精确时间信号的时间计数发生器、用于将标准视频信号和精确时间信号合成为带时间信息的视频信号的视频叠加模块、用于对被测设备进行编码的编码器、用于对被测设备进行解码的解码器和用于将接收两路信号转换为双画面显示的双通道显示器,所述视频叠加模块具有第一输入端、第二输入端、第一输出端和第二输出端,所述双通道显示器具有第一输入端和第二输入端,所述视频信号发生器的输出端与视频叠加模块的第一输入端连接,所述时间计数发生器的输出端与视频叠加模块的第二输入端连接,所述视频叠加模块的第一输出端与编码器的输入端连接,所述编码器的输出端与解码器的输入端连接,所述解码器的输出端与双通道显示器的第一输入端连接,所述视频叠加模块的第二输出端与双通道显示器的第二输入端连接。
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