[实用新型]STATCOM控制系统主控板有效
| 申请号： | 201220472003.1 | 申请日： | 2012-09-14 |
| 公开（公告）号： | CN202771209U | 公开（公告）日： | 2013-03-06 |
| 发明（设计）人： | 雷烈波;李春华;谢化安;罗瑞彬;黄伟雄;刘仁恭;梁竞雷;朱永兴;江少民;邱育义;骆树权;邝丽英;卢润波;张海涛;何师 | 申请（专利权）人： | 广东电网公司东莞供电局;荣信电力电子股份有限公司 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 广州华进联合专利商标代理有限公司 44224 | 代理人： | 王茹;曾旻辉 |
| 地址： | 523000 *** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型公开了一种STATCOM控制系统主控板，包括DSP数据处理模块、FPGA控制模块、时钟管理模块；DSP数据处理模块、时钟管理模块分别与FPGA控制模块相连接；DSP数据处理模块用于数据的处理，FPGA控制模块用于数据的传输；主控板上设有Bus LVDS总线接口、总线时钟接口、电源接口和TTL总线接口用于与背板连接，主控板提供全局时钟。与现有技术相比，本实用新型的有益效果是数据处理速度快，信号传输稳定，且适用于控制系统进行多级扩展功能。 | ||
| 搜索关键词： | statcom 控制系统 主控 | ||
【主权项】：
一种STATCOM控制系统主控板，其特征在于，包括DSP数据处理模块、FPGA控制模块、时钟管理模块；DSP数据处理模块、时钟管理模块分别与FPGA控制模块相连接；DSP数据处理模块为进行数据处理的模块，FPGA控制模块为进行数据传输的模块；主控板上设有Bus LVDS总线接口、总线时钟接口、电源接口和TTL总线接口用于与背板连接，主控板提供全局时钟。
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