[实用新型]双路缓冲快速连续扫频电路有效
| 申请号： | 201220691764.6 | 申请日： | 2012-12-14 |
| 公开（公告）号： | CN202978900U | 公开（公告）日： | 2013-06-05 |
| 发明（设计）人： | 王翔;夏思宇 | 申请（专利权）人： | 四川赛狄信息技术有限公司 |
| 主分类号： | H03L7/185 | 分类号： | H03L7/185;H03L7/07 |
| 代理公司： | 成都天嘉专利事务所(普通合伙) 51211 | 代理人： | 方强 |
| 地址： | 611731 四*** | 国省代码： | 四川;51 |
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| 摘要： | 本实用新型涉及扫频电路技术，特别是一种双路缓冲快速连续扫频电路，包括DDS、一级混频器、一级滤波器、二级混频器、二级滤波器和锁相环一、锁相环二和锁相环三；DDS的输出端连接至一级混频器，一级混频器的输出端连接至一级滤波器的输入端，一级滤波器的输出端连接至二级混频器的输入端，二级混频器的输出端连接至二级滤波器的输入端；其中，一级混频器的输入端还连接锁相环一，二级混频器的输入端还连接锁相环二和锁相环三；本实用新型不受DAC的速率限制，可以通过高频率的锁相环实现大频率范围的扫描，完全可以实现500~2500MHz的连续扫描信号。 | ||
| 搜索关键词： | 缓冲 快速 连续 电路 | ||
【主权项】：
双路缓冲快速扫频电路，其特征在于：包括DDS（1）、一级混频器（2）、一级混频器（3）、二级混频器（4）、二级滤波器（5）和三个锁相环，三个锁相环分别是锁相环一（6）、锁相环二（7）和锁相环三（8）；DDS（1）的输出端连接至一级混频器（2），一级混频器（2）的输出端连接至一级混频器（3）的输入端，一级混频器（3）的输出端连接至二级混频器（4）的输入端，二级混频器（4）的输出端连接至二级滤波器（5）的输入端；其中，一级混频器（2）的输入端还连接锁相环一（6），二级混频器（4）的输入端还连接锁相环二（7）和锁相环三（8）。
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