[实用新型]一种去谐波时钟电路有效
| 申请号： | 201220701836.0 | 申请日： | 2012-12-18 |
| 公开（公告）号： | CN203027223U | 公开（公告）日： | 2013-06-26 |
| 发明（设计）人： | 周传刚;段永亮 | 申请（专利权）人： | 太原斯泰森电子科技有限公司 |
| 主分类号： | H03K5/01 | 分类号： | H03K5/01 |
| 代理公司： | 太原高欣科创专利代理事务所(普通合伙) 14109 | 代理人： | 冷锦超;邓东东 |
| 地址： | 030006 *** | 国省代码： | 山西;14 |
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| 摘要： | 本实用新型一种去谐波时钟电路，属于时钟电路技术领域，具体涉及一种能够去除终端电阻谐波影响的时钟电路；解决的技术问题是：提供一种可以去除终端电阻谐波的时钟电路；采用的技术方案是：时钟信号源的信号输出端与时钟芯片的输入端相连，所述时钟芯片的输出端通过差分线分别与终端电阻R1和终端电阻R2相连；所述终端电阻R1的一端串接退耦电容C1后接地，终端电阻R1的另一端串接退耦电容C2后接地；所述终端电阻R2的一端串接退耦电容C3后接地，终端电阻R2的另一端串接退耦电容C4后接地；本实用新型可广泛应用于时钟电路。 | ||
| 搜索关键词： | 一种 谐波 时钟 电路 | ||
【主权项】：
一种去谐波时钟电路，包括：时钟信号源（1）、时钟芯片（2）、差分线（3）和终端电阻R1、R2；所述时钟信号源（1）的信号输出端与时钟芯片（2）的输入端相连，所述时钟芯片（2）的输出端通过差分线（3）分别与终端电阻R1和终端电阻R2相连；其特征在于：所述终端电阻R1的一端串接退耦电容C1后接地，终端电阻R1的另一端串接退耦电容C2后接地；所述终端电阻R2的一端串接退耦电容C3后接地，终端电阻R2的另一端串接退耦电容C4后接地。
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