[发明专利]一种半导体器件及其制造方法无效

专利信息
申请号: 201310006320.3 申请日: 2013-01-09
公开(公告)号: CN103915439A 公开(公告)日: 2014-07-09
发明(设计)人: 刘磊;刘伟;王鹏飞 申请(专利权)人: 苏州东微半导体有限公司
主分类号: H01L27/115 分类号: H01L27/115;H01L21/8247
代理公司: 暂无信息 代理人: 暂无信息
地址: 215123 江苏省苏州市金鸡*** 国省代码: 江苏;32
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摘要: 发明属于半导体存储器技术领域,具体涉及一种半导体器件,包括至少一个半导体衬底、一个源区、一个漏区、一个浮栅、一个控制栅以及一个用于连接所述浮栅与衬底的栅控p-n结二极管。本发明所提出的半导体器件用浮栅存储信息,并通过所述栅控p-n结二极管对浮栅进行充电或放电,具有控制栅耦合率高,对数据进行存储时操作电压低的优点。本发明能够实现快速存储以及与逻辑器件和闪存器件的兼容制造。
搜索关键词: 一种 半导体器件 及其 制造 方法
【主权项】:
一种半导体器件,包括:一个具有第一种掺杂类型的半导体衬底;在所述半导体衬底内形成的具有第二种掺杂类型的源区和漏区;在所述半导体衬底内形成的介于所述源区与漏区之间的沟道区;在所述源区、沟道区和漏区之上形成的第一层绝缘薄膜;在所述漏区之上的第一层绝缘薄膜中形成的一个浮栅开口区域,所述的浮栅开口区域的靠近沟道区的一侧边沿与沟道区的距离大于1纳米;其特征在于,还包括:在所述第一层绝缘薄膜和所述浮栅开口区域之上、覆盖所述沟道区和所述的浮栅开口区域的一个作为电荷存储节点的具有第一种掺杂类型的浮栅,通过在所述浮栅之下的浮栅开口区域在所述浮栅与漏区之间形成的一个p‑n结二极管;覆盖所述浮栅与所述p‑n结二极管的第二层绝缘薄膜;在所述第二层绝缘薄膜之上、覆盖并包围所述浮栅形成的控制栅;以导电材料形成的用于将所述源区、控制栅、漏区、半导体衬底与外部电极相连接的源区的接触体、控制栅的接触体、漏区的接触体和半导体衬底的接触体。
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