[发明专利]一种数字直接频率合成器有效
| 申请号： | 201310019467.6 | 申请日： | 2013-01-18 |
| 公开（公告）号： | CN103944565B | 公开（公告）日： | 2016-11-30 |
| 发明（设计）人： | 刘马良;朱樟明;郭旭龙;杨银堂 | 申请（专利权）人： | 西安电子科技大学 |
| 主分类号： | H03L7/24 | 分类号： | H03L7/24 |
| 代理公司： | 北京银龙知识产权代理有限公司 11243 | 代理人： | 黄灿;安利霞 |
| 地址： | 710071*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明提供一种数字直接频率合成器，包括：串行接口、静态内存、第一复用器、核处理器、数模转换器、控制逻辑以及第二复用器；其中，所述串行接口的第一方向的输出端与所述静态内存的输入端连接；所述静态内存的输出端与所述第一复用器的第一输入端连接；所述第一复用器的第二输入端与所述控制逻辑连接，所述第一复用器的输出端与所述核处理器连接；所述核处理器通过一乘法器与所述数模转换器连接；所述第二复用器的第一输入端与所述静态内存连接，所述第二复用器的第二输入端与所述控制逻辑连接；所述控制逻辑还与所述串行接口连接。本发明的方案具有较高的输出带宽和较好的杂散抑制特性。 | ||
| 搜索关键词： | 一种 数字 直接 频率 合成器 | ||
【主权项】：
一种数字直接频率合成器，其特征在于，包括：串行接口、静态内存、第一复用器、核处理器、数模转换器、控制逻辑单元以及第二复用器；其中，所述串行接口的第一方向的输出端与所述静态内存的输入端连接；所述静态内存的输出端与所述第一复用器的第一输入端连接；所述第一复用器的第二输入端与所述控制逻辑连接，所述第一复用器的输出端与所述核处理器连接；所述核处理器通过一乘法器与所述数模转换器连接；所述第二复用器的第一输入端与所述静态内存连接，所述第二复用器的第二输入端与所述控制逻辑连接；所述控制逻辑单元还与所述串行接口连接；所述核处理器包括：与所述第一复用器的输出端连接的相位累加器；与所述相位累加器通过32位相位延迟加法器连接的相位映射器；所述相位延迟加法器还与所述第二复用器的输出端连接。
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