[发明专利]高速载荷数据模拟源有效

专利信息
申请号: 201310062046.1 申请日: 2013-02-27
公开(公告)号: CN103117797A 公开(公告)日: 2013-05-22
发明(设计)人: 刘兆庆;乔立岩;马云彤;朱雨;王储;彭喜元 申请(专利权)人: 哈尔滨工业大学
主分类号: H04B7/185 分类号: H04B7/185
代理公司: 哈尔滨市松花江专利商标事务所 23109 代理人: 张宏威
地址: 150001 黑龙*** 国省代码: 黑龙江;23
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摘要: 高速载荷数据模拟源,属于遥感卫星的星上有效载荷技术领域。本发明为了解决遥感卫星的数传分系统在地面调试和测试,对有效载荷频繁进行操作会造成有效载荷损坏的问题。它包括计算机、现场可编程门阵列、E2pROM、Flash阵列、SRAM、可调时钟和24路数据输出LVDS通道,24路数据输出LVDS通道形成四个数据输出通道,每个数据输出通道用于输出6路LVDS信号;现场可编程门阵列包括时钟控制单元、寄存器组、PCIe接口逻辑单元、SRAM控制器、写Flash阵列单元、读Flash阵列单元、E2pROM控制器、四个FIFO缓冲单元、PRN码生成单元和数据发送单元。本发明用于模拟星上有效载荷输出图像像素数据。
搜索关键词: 高速 载荷 数据 模拟
【主权项】:
一种高速载荷数据模拟源,它包括计算机(1),其特征在于,它还包括现场可编程门阵列(2)、E2pROM(3)、Flash阵列(4)、SRAM(5)、可调时钟(6)和24路数据输出LVDS通道(7),24路数据输出LVDS通道(7)形成四个数据输出通道,每个数据输出通道用于输出6路LVDS信号;所述Flash阵列(4)为4*4Flash阵列,现场可编程门阵列(2)包括时钟控制单元(2‑1)、寄存器组(2‑2)、PCIe接口逻辑单元(2‑3)、SRAM控制器(2‑4)、写Flash阵列单元(2‑5)、读Flash阵列单元(2‑6)、E2pROM控制器(2‑7)、四个FIFO缓冲单元(2‑8)、PRN码生成单元(2‑9)和数据发送单元(2‑10),计算机(1)用于预先生成原始图像的像素数据,该像素数据通过PCIe接口发送到PCIe接口逻辑单元(2‑3),PCIe接口逻辑单元(2‑3)的DMA引擎将像素数据通过SRAM控制器(2‑4)在SRAM(5)中缓存,再通过SRAM控制器(2‑4)经写Flash阵列单元(2‑5)缓存到Flash阵列(4)中;计算机(1)通过寄存器组(2‑2)发送启动文件加载信号给写Flash阵列单元(2‑5),写flash阵列单元(2‑5)用于缓存像素数据,写Flash阵列单元(2‑5)通过E2pROM控制器(2‑7)将Flash阵列(4)的坏块标志记录在E2pROM(3)中;计算机(1)通过寄存器组(2‑2)发送启动发送信号给读Flash阵列单元(2‑6),读Flash阵列单元(2‑6)用于读Flash阵列(4),读Flash阵列单元(2‑6)从E2pROM(3)中获得当前Flash阵列的坏块信息,读Flash阵列单元(2‑6)通过四个FIFO缓冲单元(2‑8)将数据发送给数据发送单元(2‑10);计算机(1)通过寄存器组(2‑2)发送启动PRN码加载信号给PRN码生成单元(2‑9),使PRN码生成单元(2‑9)生成PRN10、PRN15和PRN23三种伪随机码,PRN码生成单元(2‑9)生成的数据发送给数据发送单元(2‑10);计算机(1)通过发送启动LVDS数据发送信号给数据发送单元(2‑10),使数据发送单元(2‑10)开始四个通道的LVDS数据输出,可调时钟(6)的可调时钟信号发送给时钟控制单元(2‑1),时钟控制单元(2‑1)的时钟信号发送给数据发送单元(2‑10),数据发送单元(2‑10)通过24路数据输出LVDS通道(7)将接收的数据传送给遥感卫星的数传分系统。
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