[发明专利]一种改进了SPI接口子模块的智能卡模块有效
| 申请号： | 201310124518.1 | 申请日： | 2013-04-11 |
| 公开（公告）号： | CN103164349A | 公开（公告）日： | 2013-06-19 |
| 发明（设计）人： | 曾华新;黄小鹏 | 申请（专利权）人： | 东信和平科技股份有限公司 |
| 主分类号： | G06F12/08 | 分类号： | G06F12/08 |
| 代理公司： | 广州三环专利代理有限公司 44202 | 代理人： | 温旭 |
| 地址： | 519000 广东*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供一种改进了SPI接口子模块的智能卡模块，所述智能卡模块包括内存、CPU和SPI接口子模块，所述SPI接口子模块与所述内存都连接在CPU的地址总线ABUS与数据总线DBUS上；所述CPU可读写所述内存的任意连续区域为FIFO缓冲区；所述SPI接口子模块内设有：用于指定接收FIFO缓冲区在智能卡模块内存的偏移地址的寄存器rFIFOoffset、用于指定接收FIFO缓冲区长度的寄存器rFIFOLen、用于指定已接收到的在FIFO缓冲区内数据的长度的寄存器rLen、用于指定发送FIFO缓冲区在智能卡内存偏移地址的寄存器sFIFOoffset、用于指定发送FIFO缓冲区的长度的寄存器sLen。 | ||
| 搜索关键词： | 一种 改进 spi 接口 模块 智能卡 | ||
【主权项】：
一种改进了SPI接口子模块的智能卡模块，所述智能卡模块包括内存、CPU和SPI接口子模块，其特征在于：所述SPI接口子模块与所述内存都连接在CPU的地址总线ABUS与数据总线DBUS上；所述CPU可读写所述内存的任意连续区域为FIFO缓冲区；所述SPI接口子模块内设有：用于指定接收FIFO缓冲区在智能卡模块内存的偏移地址的寄存器rFIFOoffset、用于指定接收FIFO缓冲区长度的寄存器rFIFOLen、用于指定已接收到的在FIFO缓冲区内数据的长度的寄存器rLen、用于指定发送FIFO缓冲区在智能卡内存偏移地址的寄存器sFIFOoffset、用于指定发送FIFO缓冲区的长度的寄存器sLen。
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