[发明专利]一种紧耦合多控存储系统控制器之间的高速互联方法在审

专利信息
申请号: 201310195426.2 申请日: 2013-05-24
公开(公告)号: CN103257946A 公开(公告)日: 2013-08-21
发明(设计)人: 王恩东;文中领;葛峰 申请(专利权)人: 浪潮电子信息产业股份有限公司
主分类号: G06F13/38 分类号: G06F13/38
代理公司: 暂无信息 代理人: 暂无信息
地址: 250014 山东*** 国省代码: 山东;37
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摘要: 发明提供一种紧耦合多控存储系统控制器之间的高速互联方法,该方法是多控存储系统中的控制器资源调度与协调是通过系统程序进行控制器资源调度决策,进而实现不同控制器间的数据传输,存储控制器CPU将决策信息进行封装后发送至北桥扩展出的高速总线,数据交换器将数据中的目的信息进行解析,对照本地FW对应表进行总线的连接状态调整实现多控之间的数据定向传输,控制器耦合而成的集群存储系统,有的厂商采用的是存储节点堆叠,有的厂商仅仅是控制单元堆叠。不管是那种方式,其共同的优点是减少了生产的成本,使得厂商可以通过标准的模块组合形成大型存储系统,以适应大型应用系统对于存储容量和性能的要求。通过这种标准化,可以减少生产环节的成本损失,降低系统研发周期。
搜索关键词: 一种 耦合 存储系统 控制器 之间 高速 方法
【主权项】:
一种紧耦合多控存储系统控制器之间的高速互联方法, 其特征在于多控存储系统中的控制器资源调度与协调是通过系统程序进行控制器资源调度决策,进而实现不同控制器间的数据传输,存储控制器CPU将决策信息进行封装后发送至北桥扩展出的高速总线,数据交换器将数据中的目的信息进行解析,对照本地FW对应表进行总线的连接状态调整实现多控之间的数据定向传输,方法包括:(1)存储控制器通过PCIE架构高速总线的扩展;(2)多控制器间Crossbar数据的交换;(3)数据信号的识别传输,其中:1)存储控制器通过PCIE架构高速总线的扩展,存储控制器选用通用的intel架构CPU,intel架构主板上的北桥芯片用来处理高速数据信号和处理器CPU,内存RAM,PCI Express,和南桥芯片之间的通信,通过北桥芯片直接扩展出2个以上的PCIE高速总线接口,用以来实现存储控制器之间的数据传输,同步PCIE数据由起始控制器向目的控制器发送的路径为:起始控制器­缓存—>控制器上的PCIE高速总线—>PCIE交换机模块—>接受数据的控制器PCIE高速总线—>接受数据的控制器缓存;2)多控制器间Crossbar数据的交换,是通过数据交换器来实现,数据交换器用以实现2个以上控制器之间的互联,对外提供与控制器扩展接口匹配的交换接口,所有接口连接在数据交换器的高速交换背板上,通过Crossbar交叉矩阵实现所有端口的互联,端口编号与控制器编号通过FW写入数据交换器映射表中,FW中的映射关系通过数据交换器实现端到端的PCIE高速总线联通;3)数据信号的识别传输,数据传输根据控制器数量、数据镜像策略不同实现不同节点间的数据传输,控制器将数据目的地址进行封装后加入到数据包头中,在数据交换器上解析后,通过与数据交换器中的映射表比较实现数据传输至其相应端口,具体互联步骤如下:(1)存储数据信息发送至PCIE高速总线,总线数据的发送需要控制总线、地址总线、数据总线,首先存储控制器通过数据交换器中的控制芯片仲裁机制获取PCIE高速总线网络端口控制权;(2)获取PCIE高速总线网络端口控制权根据整个多控系统的资源调度策略进行优化,促使系统中的总线使用效率及仲裁机制完美结合;A)控制器1中数据传输至控制器2、3,控制器1首先通过空闲控制总线申请到总线端口控制权;B)控制器1目的地址数据传输至总线数据交换器,其决策控制芯片将控制器1、2位置连通,释放总线控制申请;C)控制器1将数据传输至PCIE高速总线;D)控制器2、3接收总线数据;E)数据传输完毕,控制器1通知总线控制装置释放PCIE高速总线端口;(3)本地将封装有目的地址信息的总线数据传输至总线之上,数据交换器控制芯片解析地址信息,并与FW表进行比照后连通源、目标总线端口;(4)数据在PCIE高速总线上形成高速传输;(5)传输结束释放占用的PCIE高速总线端口以便其他获取总线控制权的设备申请PCIE高速总线端口。
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