[发明专利]单副载波模式信号解码器有效
申请号: | 201310250634.8 | 申请日: | 2013-06-21 |
公开(公告)号: | CN104242955B | 公开(公告)日: | 2017-03-15 |
发明(设计)人: | 王吉健 | 申请(专利权)人: | 上海华虹集成电路有限责任公司 |
主分类号: | H03M13/09 | 分类号: | H03M13/09 |
代理公司: | 上海浦一知识产权代理有限公司31211 | 代理人: | 戴广志 |
地址: | 201203 上海*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种解码ISO/IEC15693协议中读卡器发送的单副载波模式信号解码器。包括一数字累加器,一边界检测电路,一副载波判决电路,一帧头检测电路,一数据解码有效标志产生电路,一数据解码电路,一帧尾检测电路,一状态标志产生电路,一接收编码错误检测逻辑电路;利用数字累加器对半个数据编码周期内的副载波高电平信号进行累加,通过累加值得到编码周期内的副载波在编码周期内的存在位置,然后对照ISO/IEC15693协议规定的编码规律,利用状态标志产生电路,来检测帧头,帧尾,对数据解码以及产生编码错误标志。本发明能有效提高其抗干扰性能。 | ||
搜索关键词: | 载波 模式 信号 解码器 | ||
【主权项】:
一种解码ISO/IEC 15693协议中读卡器发送的单副载波模式信号解码器,其特征在于,用模拟射频解调模块解调输出的载波频率的时钟作为时钟信号,包括:一数字累加器,对输入的副载波包络信号累加,产生并输出接收开始信号,并且记录半个数据编码周期内的副载波高电平长度;一边界检测电路,与所述数字累加器相连接,以半个数据编码周期为周期进行计数,当计数到半个数据编码周期时,产生边界标志信号,在所述周期内的一个时间点,产生采样标志信号;一副载波判决电路,与所述数字累加器和边界检测电路相连接,用于判决半个数据编码周期内是否含有副载波;产生并输出副载波存在标志信号和经缓存的副载波存在标志信号;一帧头检测电路,与所述边界检测电路和副载波判决电路相连接,用于检测帧头波形信号,产生并输出帧头标志信号;一数据解码有效标志产生电路,与所述边界检测电路相连接,用于产生并输出数据解码预有效标志信号和数据解码有效标志信号;一数据解码电路,与所述副载波判决电路和数据解码有效标志产生电路相连接,根据ISO/IEC 15693协议中的数据编码波形进行解码,产生并输出解码数据信号;一帧尾检测电路,与所述边界检测电路、数据解码电路、数据解码有效标志产生电路和副载波判决电路相连接,根据ISO/IEC 15693协议中的帧尾波形,检测帧尾波形信号,产生并输出帧尾标志信号;一状态标志产生电路,与所述边界检测电路、数据解码有效标志产生电路、帧头检测电路和帧尾检测电路相连接,用于产生不同状态标志信号,区分不同接收阶段;一接收编码错误检测逻辑电路,与所述边界检测电路、副载波判决电路、数据解码电路、状态标志产生电路和数据解码有效标志产生电路相连接,根据数据编码特点,进行编码错误检测。
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