[发明专利]半导体器件及其制造方法有效

专利信息
申请号: 201310285905.3 申请日: 2013-07-09
公开(公告)号: CN103545317A 公开(公告)日: 2014-01-29
发明(设计)人: 有金刚;久本大;奥山裕;桥本孝司;冈田大介 申请(专利权)人: 瑞萨电子株式会社
主分类号: H01L27/115 分类号: H01L27/115;H01L21/8247
代理公司: 中原信达知识产权代理有限责任公司 11219 代理人: 李兰;孙志湧
地址: 日本神*** 国省代码: 日本;JP
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摘要: 发明提供了一种半导体器件及其制造方法。当通过缩小存储器单元而减小隔离区的宽度,以减小在存储器单元和相邻存储器单元之间的距离时,被注入到存储器单元的电荷存储膜中的电子或空穴扩散到位于隔离区上方的电荷存储膜的部分中,从而彼此相互干扰,并且可能损害存储器单元的可靠性。在半导体器件中,存储器单元的电荷存储膜延伸至位于相邻存储器单元之间的隔离区。隔离区中的电荷存储膜的有效长度大于隔离区的宽度。这里,有效长度指示位于隔离区上方且没有存储电荷的电荷存储膜的区域的长度。
搜索关键词: 半导体器件 及其 制造 方法
【主权项】:
一种半导体器件,包括:半导体衬底,所述半导体衬底具有主表面;多个存储器单元,所述存储器单元每个均存在于所述半导体衬底的选择的区域中;以及隔离区,所述隔离区位于与其为相邻关系的所述存储器单元之间,以在所述存储器单元之间提供隔离,其中所述存储器单元的每一个具有位于所述半导体衬底的所述主表面上方的电荷存储膜,以及位于所述电荷存储膜上方的存储器栅极,其中所述隔离区的上表面存在于所述半导体衬底的所述主表面下方的位置,其中所述存储器单元的所述电荷存储膜和所述存储器栅极在所述隔离区上方延伸至相邻的存储器单元,并且其中位于所述隔离区上方且没有存储电荷的所述电荷存储膜的区域的长度大于所述隔离区的宽度。
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