[发明专利]参数化的BCH纠错码的并行编码方法及装置无效
| 申请号： | 201310340916.7 | 申请日： | 2013-08-06 |
| 公开（公告）号： | CN103401566A | 公开（公告）日： | 2013-11-20 |
| 发明（设计）人： | 李东新;周桑彦 | 申请（专利权）人： | 河海大学 |
| 主分类号： | H03M13/15 | 分类号： | H03M13/15 |
| 代理公司： | 南京苏高专利商标事务所(普通合伙) 32204 | 代理人： | 李玉平 |
| 地址： | 211100 江*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了参数化的BCH纠错码的并行编码方法及装置，在确定了可纠错位数t，并行编码的位宽p，数据信息位的长度k，三个可变参数之后，求解生成多项式矩阵，生成多项式g(X)的次数为(n-k)；校验位的临时变量与生成多项式矩阵进行逻辑运算，最后输出一个用verilog HDL语言来描述的完整的编码模块。生成的编码模块的编码速度快，占用资源少。该编码模块利用一个生成矩阵来时来实现其并行编码功能，它是根据BCH码的生成多项式，经过一系列的运算最终而求解出来的。本发明适用于码字较长，编码速率较高，且纠错编码的纠错能力能继续提高的应用中。 | ||
| 搜索关键词： | 参数 bch 纠错码 并行 编码 方法 装置 | ||
【主权项】：
一种参数化的BCH纠错码的并行编码方法，其特征在于，包括如下步骤：确定纠错码的纠错能力，即确定可纠错位数t，以及信息位的长度k；求解生成多项式矩阵，生成多项式g(X)的次数为(n‑k)；并行编码的位数为p，校验位的临时变量与生成多项式矩阵进行逻辑运算，最后输出编码结果；其中，输入的信息位长度k可以被并行编码的位数p分割为k/p等份，如果kmodp＝0，且并行编码的位数p是小于生成多项式的次数(n‑k)，则经过k/p个节拍，可完成全部的编码；如果kmodp≠0，在信息位中添加额外的z位0使得(k+z)modp＝0，其中z的值是固定的。
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