[发明专利]CMOS晶体管的形成方法有效
申请号: | 201310342916.0 | 申请日: | 2013-08-07 |
公开(公告)号: | CN104347512B | 公开(公告)日: | 2017-07-14 |
发明(设计)人: | 禹国宾 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L21/324 |
代理公司: | 北京集佳知识产权代理有限公司11227 | 代理人: | 骆苏华 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种CMOS晶体管的形成方法,包括提供半导体衬底;在所述半导体衬底的第一区域和第二区域形成栅极结构;在所述第一区域的栅极结构两侧的半导体衬底内形成第一凹槽;在所述第一凹槽内填充满第一应力层;在所述第二区域的栅极结构两侧的半导体衬底内形成第二凹槽;在所述第二凹槽内填充满第二应力层,所述第二应力层的应力类型与第一应力层相反;在所述第一栅极结构两侧半导体衬底表面形成第一碳化硅外延层,同时在第二栅极结构两侧半导体衬底表面形成第二碳化硅外延层。本发明能防止CMOS晶体管沟道区出现倒菱锥形尖峰,减小CMOS晶体管的漏电流,提高CMOS晶体管的可靠性以及成品率。 | ||
搜索关键词: | cmos 晶体管 形成 方法 | ||
【主权项】:
一种CMOS晶体管的形成方法,其特征在于,包括:提供半导体衬底,所述半导体衬底包括第一区域和第二区域,所述第一区域的半导体衬底表面形成有第一栅极结构,所述第二区域的半导体衬底表面形成有第二栅极结构;在所述第一栅极结构两侧的半导体衬底内形成第一凹槽;在所述第一凹槽内填充满第一应力层;在所述第二栅极结构两侧的半导体衬底内形成第二凹槽;在所述第二凹槽内填充满第二应力层,所述第二应力层的应力类型与第一应力层的类型相反;在所述第一栅极结构两侧的半导体衬底表面形成第一碳化硅外延层,同时在所述第二栅极结构两侧的半导体衬底表面形成第二碳化硅外延层;对所述第一栅极结构两侧的半导体衬底和第一碳化硅外延层进行掺杂,形成第一源区和第一漏区;对所述第二栅极结构两侧的半导体衬底和第二碳化硅外延层进行掺杂,形成第二源区和第二漏区;在所述第一碳化硅外延层表面淀积第一金属层,同时在第二碳化硅外延层表面淀积第二金属层;对第一金属层和第二金属层进行退火处理,在第一源区和第一漏区表面形成第一金属硅化物层,同时在第二源区和第二漏区表面形成第二金属硅化物层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造