[发明专利]处理器、信息处理设备以及电力消耗管理方法无效
申请号: | 201310378857.2 | 申请日: | 2013-08-27 |
公开(公告)号: | CN103677206A | 公开(公告)日: | 2014-03-26 |
发明(设计)人: | 鲤沼秀之;福村祐美;原充治;影山弘进;吉田利雄 | 申请(专利权)人: | 富士通株式会社 |
主分类号: | G06F1/32 | 分类号: | G06F1/32;G06F1/26 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 朱胜;陈炜 |
地址: | 日本神*** | 国省代码: | 日本;JP |
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摘要: | 本发明提供了一种处理器、信息处理设备以及电力消耗管理方法。当电流传感器22的检测结果表示出现过电流时,PSU2的比较器23将指示该事实的存在报告传送至SP1。接收到该存在报告,SP1的FPGA12接通强制低电力信号。CPU3的强制省电控制电路32直接输入强制低电力模式信号,接通该信号,并且控制CPU3中被配置成发布命令的命令发布控制单元,以便立即降低命令发布控制单元发布命令的频率。在DVFS控制电路35降低了从DDC4输出的电力的电压和从PLL电路输出的时钟频率之后,取消该控制。 | ||
搜索关键词: | 处理器 信息处理 设备 以及 电力 消耗 管理 方法 | ||
【主权项】:
一种处理器,包括:命令发布控制电路,被配置成控制命令的发布;命令处理电路,被配置成执行所述命令发布控制电路发布的命令;指示输入电路,被配置成从外部输入与电力消耗有关的电力指示;以及执行频率控制电路,被配置成当所述指示输入电路输入的电力指示要求抑制所述电力消耗时,控制所述命令发布控制电路、或所述命令处理电路、或其任意组合,以便降低所述命令处理电路执行命令的执行频率。
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