[发明专利]一种基于FPGA的多路信号同步采样控制电路有效
| 申请号： | 201310613715.X | 申请日： | 2013-11-28 |
| 公开（公告）号： | CN103592881B | 公开（公告）日： | 2017-06-16 |
| 发明（设计）人： | 潘海鸿;韦庆情;陈琳;黄炳琼 | 申请（专利权）人： | 广西大学 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 530004 广西*** | 国省代码： | 广西;45 |
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| 摘要： | 本发明公开了一种基于FPGA的多路信号同步采样控制电路，至少包括多路信号采样接口电路、晶振电路、FPGA芯片和微处理器；FPGA芯片至少包括多路信号采样并行处理模块、同步锁存模块、输出控制模块、地址译码模块和同步锁存信号产生模块；同步锁存信号产生模块输出的同步锁存信号SYNL控制同步锁存模块将多路信号采样并行处理模块输出的多路数据同步锁存，使多路信号采样并行处理模块输出的同一个时刻的多路数据保持不变，保证了微处理器从FPGA芯片中逐一读取的各路数据之间的同步性。本发明适用于要求多路信号同步采样的控制系统，尤其适用于多路脉冲信号或多路数字信号的同步采样的控制系统，灵活方便，实用性强。 | ||
| 搜索关键词： | 一种 基于 fpga 信号 同步 采样 控制电路 | ||
【主权项】：
一种基于FPGA的多路信号同步采样控制电路，至少包括多路信号采样接口电路(1)、晶振电路(2)、FPGA芯片(3)和微处理器(4)，其特征在于：所述FPGA芯片(3)至少包括多路信号采样并行处理模块(31)、同步锁存模块(32)、输出控制模块(33)、地址译码模块(34)和同步锁存信号产生模块(35)；所述晶振电路(2)输出的时钟信号clock分别输入到FPGA芯片(3)的多路信号采样并行处理模块(31)、同步锁存模块(32)和同步锁存信号产生模块(35)；所述同步锁存信号产生模块(35)输出的同步锁存信号SYNL输入到同步锁存模块(32)；所述同步锁存信号SYNL控制同步锁存模块(32)将多路信号采样并行处理模块(31)输出的数据d1，d2，…，dn同步锁存为同步锁存模块(32)输出的数据sd1，sd2，…，sdn；所述FPGA芯片(3)的地址译码模块(34)的输出端分别与输出控制模块(33)的输入端和同步锁存信号产生模块(35)的输入端相连；所述地址译码模块(34)输出的译码信号a1，a2，…，an输入到输出控制模块(33)，所述地址译码模块(34)输出的控制信号CTL和同步信号SYN2输入到同步锁存信号产生模块(35)；所述微处理器(4)通过数据总线和读控制信号与FPGA芯片(3)的输出控制模块(33)相连；所述微处理器(4)通过地址总线与FPGA芯片(3)的地址译码模块(34)相连；所述微处理器(4)通过数据总线、读控制信号、写控制信号、同步信号SYN3和输出保持信号HOLD与FPGA芯片(3)的同步锁存信号产生模块(35)相连。
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