[实用新型]实时时钟芯片的时钟定时报警模块有效
| 申请号： | 201320189717.6 | 申请日： | 2013-04-14 |
| 公开（公告）号： | CN203180867U | 公开（公告）日： | 2013-09-04 |
| 发明（设计）人： | 卢斌 | 申请（专利权）人： | 嵊州市华丰电子有限公司 |
| 主分类号： | H03K3/02 | 分类号： | H03K3/02 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 312400 浙*** | 国省代码： | 浙江;33 |
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| 摘要： | 本实用新型公开了实时时钟芯片的时钟定时报警模块，包括串行时钟接口电路和串行数据接口电路，串行时钟接口电路依次连接九进制计数器、移位寄存器的时钟及控制信号、8位移位寄存器和检测读写位，串行数据接口电路依次连接检测应答位、8位移位寄存器和初始化信号，九进制计数器依次连接检测应答位和初始化信号，8位移位寄存器依次连接产生串行输出和输出电路，进一步，8位移位寄存器依次连接检测片选和检测读写位。本实用新型能够可靠完成分、时、周和分、时的定时报警功能，有效保证实时时钟的高精度要求。 | ||
| 搜索关键词： | 实时 时钟 芯片 定时 报警 模块 | ||
【主权项】：
实时时钟芯片的时钟定时报警模块，其特征在于：包括串行时钟接口电路和串行数据接口电路，所述串行时钟接口电路依次连接九进制计数器、移位寄存器的时钟及控制信号、8位移位寄存器和检测读写位，所述串行数据接口电路依次连接检测应答位、所述8位移位寄存器和初始化信号，所述九进制计数器依次连接所述检测应答位和所述初始化信号，所述8位移位寄存器依次连接产生串行输出和输出电路。
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