[实用新型]一种驱动高容性负载的CMOS缓冲器电路有效
| 申请号： | 201320305351.4 | 申请日： | 2013-05-30 |
| 公开（公告）号： | CN203289404U | 公开（公告）日： | 2013-11-13 |
| 发明（设计）人： | 谢亮;段杰斌;张文杰;金湘亮 | 申请（专利权）人： | 湘潭芯力特电子科技有限公司 |
| 主分类号： | H03K19/0948 | 分类号： | H03K19/0948 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 411104 湖南省湘*** | 国省代码： | 湖南;43 |
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| 摘要： | 本实用新型公开了一种驱动高容性负载的CMOS缓冲器电路，主要应用于高精度信号处理系统，包括第一级运算放大器，压控电流源，第二级运算放大器，所述第一级运算放大器的正向输入端接输入信号，所述第一级运算放大器输出端与所述的压控电流源输出端和第二级运算放大器输入端相连接；所述第二级运算放大器的输出端与所述第一级运算放大器的反向输入端相连接。本实用新型取得的积极效果是：电路结构简单、高性能、能够驱动高容性负载，成本低，易于大范围的推广。 | ||
| 搜索关键词： | 一种 驱动 高容性 负载 cmos 缓冲器 电路 | ||
【主权项】：
一种驱动高容性负载的CMOS缓冲器电路，包括第一级运算放大器，压控电流源，第二级运算放大器，其特征在于：所述第一级运算放大器的正向输入端接输入信号，所述第一级运算放大器输出端与所述的压控电流源输出端和第二级运算放大器输入端相连接；所述第二级运算放大器的输出端与所述第一级运算放大器的反向输入端相连接。
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