[实用新型]基于FPGA的网络Smurf攻击特征瞬时防御电路有效

专利信息
申请号: 201320509543.7 申请日: 2013-08-20
公开(公告)号: CN203800957U 公开(公告)日: 2014-08-27
发明(设计)人: 鲍兴川;林为民;余勇;郭经红;张小建;蒋诚智;郭骞;曹宛恬;石聪聪;李尼格;范杰;冯谷;高鹏 申请(专利权)人: 国家电网公司;中国电力科学研究院
主分类号: H04L29/06 分类号: H04L29/06
代理公司: 北京安博达知识产权代理有限公司 11271 代理人: 徐国文
地址: 100031 *** 国省代码: 北京;11
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摘要: 实用新型提供了一种基于FPGA的网络Smurf攻击特征瞬时防御电路,防御电路设置在以太网接口的数据链路层和数据物理层之间;寄存器电路和逻辑电路依次连接于双路半字节计数/控制器与FIFO缓存器之间;出向FIFO缓存器和入向FIFO缓存器通过MII接口连接于MAC电路和PHY电路之间;双路半字节计数/控制器通过对网络报文的半字节计数锁存寄存器,并控制出向逻辑电路和入向逻辑电路的开启和关断;出向逻辑电路和入向逻辑电路控制FIFO缓存器分别将数据包发送到外部网络和CPU。和现有技术相比,本实用新型提供的一种基于FPGA的网络Smurf攻击特征瞬时防御电路,纯硬件实现、实时性高、灵活性高、不占CPU资源和实际网口带宽,具有较高稳定性。
搜索关键词: 基于 fpga 网络 smurf 攻击 特征 瞬时 防御 电路
【主权项】:
一种基于FPGA的网络Smurf攻击特征瞬时防御电路,其特征在于,所述防御电路设置在以太网接口的数据链路层和数据物理层之间;出向寄存器电路和出向逻辑电路依次连接于计数/控制器与出向FIFO缓存器之间;入向寄存器电路和入向逻辑电路依次连接于所述计数/控制器与入向FIFO缓存器之间;所述出向FIFO缓存器和所述入向FIFO缓存器通过MII接口连接于MAC电路和PHY电路之间; 所述计数/控制器通过对网络报文的半字节计数锁存寄存器,从而控制所述出向寄存器电路和所述入向寄存器电路的输出电平;所述计数/控制器控制所述出向逻辑电路和所述入向逻辑电路的开启和关断;所述出向FIFO缓存器缓存CPU发出的数据包,所述出向逻辑电路控制所述出向FIFO缓存器将所述数据包发送到外部网络;所述入向FIFO缓存器缓存由外部网络发送到所述CPU的数据包,所述入向逻辑电路控制所述入向FIFO缓存器将所述数据包发送到所述CPU。 
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