[实用新型]一种介质访问控制器XMACII有效
| 申请号： | 201320748038.8 | 申请日： | 2013-11-25 |
| 公开（公告）号： | CN203574689U | 公开（公告）日： | 2014-04-30 |
| 发明（设计）人： | 韩毅 | 申请（专利权）人： | 成都兆益科技发展有限责任公司 |
| 主分类号： | H04L29/06 | 分类号： | H04L29/06;H04L12/823 |
| 代理公司： | 成都华典专利事务所(普通合伙) 51223 | 代理人： | 徐丰;杨保刚 |
| 地址： | 610041 四川省*** | 国省代码： | 四川;51 |
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| 摘要： | 本实用新型公开了一种介质访问控制器XMACIIACII，包括FIFO控制逻辑、MAC、PCS、寄存器、以太网收发器、FPGA、时钟控制接口；所述FIFO控制逻辑包括发送FIFO和接收FIFO；MAC包括发送状态机和接收状态机；PCS包括带FC-0接口的译码/解码器、带GMII接口的GMII；寄存器包括管理寄存器和控制接口；时钟控制接口与寄存器相连接，寄存器与FIFO控制逻辑和FPGA相连接，FIFO控制逻辑与MAC相连接，MAC与PCS相连接，PCS内的带FC-0接口的8B10BPCS译码/解码器与以太网收发器相连接，本实用新型在于：实现数据转换器和各个器件读写数据的逻辑时序，提高工作高效率，减少维护，实现数据的高速传送。 | ||
| 搜索关键词： | 一种 介质 访问 控制器 xmacii | ||
【主权项】：
一种介质访问控制器XMACIIACII，其特征在于：包括FIFO控制逻辑、MAC、PCS、寄存器、以太网收发器、FPGA、时钟控制接口；所述FIFO控制逻辑包括发送FIFO和接收FIFO；MAC包括发送状态机和接收状态机；PCS包括带FC‑0接口的译码/解码器、带GMII接口的GMII；寄存器包括管理寄存器和控制接口；时钟控制接口与寄存器相连接，寄存器与FIFO控制逻辑和FPGA相连接，FIFO控制逻辑与MAC相连接，MAC与PCS相连接，PCS内的带FC‑0接口的8B10BPCS译码/解码器与以太网收发器相连接。
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