[实用新型]USB3.0FPGA开发板有效
| 申请号： | 201320796747.3 | 申请日： | 2013-12-04 |
| 公开（公告）号： | CN203658909U | 公开（公告）日： | 2014-06-18 |
| 发明（设计）人： | 高韦;王亚君 | 申请（专利权）人： | 安徽虹庄微电子有限公司 |
| 主分类号： | G06F1/16 | 分类号： | G06F1/16 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 230000 安徽省合肥市高新区望江西路800号*** | 国省代码： | 安徽;34 |
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| 摘要： | 本实用新型公开了USB3.0FPGA开发板，包括FPGA、USB3.0PHY、DDR2SDRAM、48MHz有源晶振、JTAG、EEPROM、USB3.0标准B型口、复位电路、电源、40MHz有源晶振；其中USB3.0PHY通过PIPE信号和FPGA上的bank4和bank5连接；USB3.0PHY通过ULPI信号和FPGA上的bank4连接；USB3.0PHY与USB3.0标准B型口连接；USB3.0PHY与40MHz有源晶振连接；FPGA通过FPGA上的bank2和bank3与DDR2SDRAM连接；FPGA通过FPGA上的bank1和bank6与EEPROM连接；FPGA分别与48MHz有源晶振、JTAG、电源、复位电路连接；FPGA上的bank7和bank8为用户IO口。本实用新型为超高速USB3.0设备接口应用的开发和原型设计提供了硬件和软件平台。 | ||
| 搜索关键词： | usb3 fpga 开发 | ||
【主权项】：
USB3.0FPGA开发板，其特征在于：包括FPGA、USB3.0PHY、DDR2SDRAM、48MHz有源晶振、JTAG、EEPROM、USB3.0标准B型口、复位电路、电源、40MHz有源晶振；所述USB3.0PHY通过PIPE信号和所述FPGA上的bank4和bank5连接；所述USB3.0PHY通过ULPI信号和所述FPGA上的bank4连接；所述USB3.0PHY与所述USB3.0标准B型口连接；所述USB3.0PHY与所述40MHz有源晶振连接；所述FPGA通过所述FPGA上的bank2和bank3与所述DDR2SDRAM连接；所述FPGA与所述48MHz有源晶振连接；所述FPGA与所述JTAG连接；所述FPGA通过所述FPGA上的bank1和bank6与所述EEPROM连接；所述FPGA与所述电源连接；所述FPGA与所述复位电路连接；所述FPGA上的bank7和bank8为用户IO口。
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