[发明专利]形成用于非易失性存储器阵列的叠层栅结构的方法有效
申请号: | 201380022225.0 | 申请日: | 2013-02-01 |
公开(公告)号: | CN104246985B | 公开(公告)日: | 2017-05-24 |
发明(设计)人: | W.托伦;X.刘;G.梅茨格尔-布吕克尔;N.杜;S.维格;N.米里迪;C.苏;C.伯纳迪;L.奎瓦斯;F.居约;Y.陈;H.奧马尼;M.塔达约尼 | 申请(专利权)人: | 硅存储技术公司 |
主分类号: | H01L21/28 | 分类号: | H01L21/28 |
代理公司: | 中国专利代理(香港)有限公司72001 | 代理人: | 马红梅,陈岚 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | 一种用于非易失性存储器阵列的叠层栅结构具有半导体衬底,所述半导体衬底具有多个基本上平行的间隔开的有源区。叠层栅结构在有源区上方形成,并且每一个包括在每个叠层栅结构之间的在垂直于第一方向的第二方向上的第一绝缘材料,在所述有源区上方的第二绝缘材料,在所述第二绝缘材料上方的电荷维持栅极,在所述电荷维持栅极上方的第三绝缘材料,在所述第三绝缘材料上方的控制栅极的第一部分,所述控制栅极的第二部分在所述控制栅极的所述第一部分的顶部表面上方以及在与之相邻并沿所述第二方向延伸的所述第一绝缘材料的顶部表面上方,并且第四绝缘材料在所述控制栅极的所述第二部分上方。 | ||
搜索关键词: | 形成 用于 非易失性存储器 阵列 叠层栅 结构 方法 | ||
【主权项】:
一种形成用于非易失性存储器阵列的多个相连的叠层栅结构的方法,所述方法包括:通过以下方式形成叠层栅结构:在半导体衬底上形成第一绝缘层;在所述第一绝缘层上形成电荷维持层;在所述电荷维持层上方形成第二绝缘层;在所述第二绝缘层上方形成第一多晶硅层,其中所述第一多晶硅层具有第一顶部表面;在所述第一多晶硅层的所述第一顶部表面上方用第三绝缘材料形成第三绝缘层;在所述第三绝缘层上方形成第一牺牲层,其中所述第一牺牲层具有第二顶部表面;在多个间隔开的平行的区域中,以从所述第二顶部表面向下进入所述半导体衬底中的方式来蚀刻所述叠层栅结构,其中每个区域沿第一方向延伸;用所述第三绝缘材料填充蚀刻后的间隔开的区域,从而在所述半导体衬底中在相邻的有源区之间,以及在相邻的叠层栅结构之间形成隔离区;使所述第三绝缘材料平坦化以使得在所述蚀刻后的间隔开的区域上方的所述第三绝缘材料的所述顶部表面与所述第二顶部表面共平面;移除所述第一牺牲层;蚀刻所述第三绝缘材料以使得所述第一多晶硅层的所述第一顶部表面清除了任何第三绝缘材料;在所述第一多晶硅层上方以及在所述蚀刻后的间隔开的区域上方的所述第三绝缘材料上方形成第二多晶硅层,连接所述多个间隔开的叠层栅结构;在所述第二多晶硅层上方形成第四绝缘材料;以及在垂直于所述第一方向的第二方向上蚀刻所得的结构;其中蚀刻所述第三绝缘层的所述步骤将叠层栅结构之间的所述第三绝缘材料蚀刻成与所述第一多晶硅层的所述顶部表面共平面。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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