[发明专利]用于多核/众核可编程逻辑控制器的时间裕隙应用流水线平衡有效
| 申请号： | 201380026256.3 | 申请日： | 2013-04-19 |
| 公开（公告）号： | CN104321747B | 公开（公告）日： | 2017-11-17 |
| 发明（设计）人： | A.马丁内斯卡内多;T.费克廷格;M.A.阿尔法鲁奎 | 申请（专利权）人： | 西门子公司 |
| 主分类号： | G06F9/45 | 分类号： | G06F9/45 |
| 代理公司： | 北京市柳沈律师事务所11105 | 代理人： | 谢强,熊雪梅 |
| 地址： | 美国新*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明涉及一种用于为多核/众核可编程逻辑控制器执行时间裕隙流水线平衡的方法，包括在用于多核/众核可编程逻辑控制器(PLC)的程序被执行时对该程序的多个流水线阶段执行(411)运行时间分析，以及对多个系统服务执行运行时间分析，以编译PLC程序和系统服务的性能统计的配置文件；使用性能统计配置文件来计算(413)关于PLC程序的多个流水线阶段的每一个的时间裕隙；以及，对于除最长阶段之外的所有流水线阶段，将每一个流水线阶段的时间裕隙捐献(414)给PLC的操作系统。捐献每一个流水线阶段的时间裕隙包括生成由一组指令组成的施主代码，所述指令在被识别为时间裕隙时期的时间段内释放处理器核用于给定的流水线阶段。 | ||
| 搜索关键词： | 用于 多核 可编程 逻辑 控制器 时间 应用 流水线 平衡 | ||
【主权项】：
一种用于为多核/众核可编程逻辑控制器执行时间裕隙流水线平衡的方法，包括下述步骤：读取用于多核/众核可编程逻辑控制器PLC的源程序进入适当编译器，编译器生成程序的低级中间表示，使用对所述PLC程序的中间表示的时序分析结果，计算所述PLC程序中的多个流水线阶段的每一个的时间裕隙，其中时间裕隙用来指浪费在忙等待循环或类似实现中的较短流水线阶段上用于等待数据信号以触发其计算的时间，其中，PLC程序被划分为多个流水线阶段；对于除最长阶段之外的所有流水线阶段，将每一流水线阶段的所述时间裕隙捐献给所述PLC的操作系统；其中，捐献每一流水线阶段的所述时间裕隙包括生成由一组指令组成的施主代码，所述指令在被识别为时间裕隙时期的时间段内释放处理器核用于给定的流水线阶段；以及发送用于所述PLC程序的机器可执行代码。
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