[发明专利]具有高抗干扰性的高速缓冲器有效
| 申请号： | 201380057886.7 | 申请日： | 2013-10-23 |
| 公开（公告）号： | CN104769843A | 公开（公告）日： | 2015-07-08 |
| 发明（设计）人： | E.H.比扬 | 申请（专利权）人： | 桑迪士克科技股份有限公司 |
| 主分类号： | H03K5/1252 | 分类号： | H03K5/1252;G11C7/10 |
| 代理公司： | 北京市柳沈律师事务所 11105 | 代理人： | 黄剑飞 |
| 地址： | 美国得*** | 国省代码： | 美国;US |
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| 摘要： | 本公开提供用于提供具有高抗干扰性的高速操作的电路、装置、系统和方法的示例。在一实现方式中，电路包括第一缓冲器，其被配置为接收输入信号并产生第一输出信号。所述电路还包括第二缓冲器，其被配置为接收所述输入信号并产生第二输出信号。所述第二缓冲器显现具有下和上阈值的滞后。所述电路还包括输出块，其被配置为接收所述第一和第二输出信号并产生第三输出信号。所述输出块被配置为响应于所述第一输出信号的逻辑状态的转变切换所述第三输出信号的逻辑状态，并且锁定所述第三输出信号的逻辑状态直到所述输出块接收所述第二输出信号的逻辑状态的转变。 | ||
| 搜索关键词： | 具有 抗干扰 高速 缓冲器 | ||
【主权项】：
一种电路，包括：第一缓冲器，其被配置为接收输入信号并基于所述输入信号产生第一输出信号；第二缓冲器，其被配置为接收所述输入信号并基于所述输入信号产生第二输出信号，所述第二缓冲器显现具有下阈值和上阈值的滞后；以及输出块，其被配置为接收所述第一输出信号和所述第二输出信号并基于所述第一输出信号和第二输出信号产生第三输出信号，所述输出块被配置为响应于所述第一输出信号的逻辑状态的转变而切换所述第三输出信号的逻辑状态，并且锁定所述第三输出信号的逻辑状态直到所述输出块接收所述第二输出信号的逻辑状态的转变为止。
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