[发明专利]在视频译码中的低延迟缓冲模型有效
| 申请号： | 201380065800.5 | 申请日： | 2013-12-10 |
| 公开（公告）号： | CN104854870B | 公开（公告）日： | 2018-12-04 |
| 发明（设计）人： | 王益魁 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | H04N19/70 | 分类号： | H04N19/70;H04N19/174;H04N19/42;H04N19/433;H04N19/172 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 宋献涛 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明揭示用于在视频译码过程中的低延迟缓冲的技术。视频解码技术可包含：接收用于经解码图片的第一经解码图片缓冲器DPB输出延迟及第二DPB输出延迟；在用于视频解码器的假设参考解码器HRD设置指示在图片级别处的操作的状况下针对所述经解码图片而使用所述第一DPB输出延迟来确定第一DPB输出时间；及在用于所述视频解码器的所述HRD设置指示在子图片级别处的操作的状况下针对所述经解码图片而使用所述第二DPB输出延迟来确定第二DPB输出时间。 | ||
| 搜索关键词： | 视频 译码 中的 延迟 缓冲 模型 | ||
【主权项】：
1.一种解码视频的方法，所述方法包括：接收第一经解码图片缓冲器DPB输出延迟及第二DPB输出延迟，其中在图片时序SEI消息或者解码单元信息SEI消息中发信所述第二DPB输出延迟；确定假设参考解码器HRD设置指示在存取单元级别处的操作还是在子图片级别处的操作；及基于所述HRD设置指示在所述存取单元级别处的操作的确定，由视频解码装置针对经解码图片而基于所述第一DPB输出延迟和图片时钟计时周期来确定第一DPB输出时间，及基于所述HRD设置指示在所述子图片级别处的操作的确定：基于所述图片时钟计时周期和计时周期除数值而推导子图片时钟计时周期；及由所述视频解码装置针对所述经解码图片而基于所述第二DPB输出延迟和所述子图片时钟计时周期来确定第二DPB输出时间。
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