[发明专利]硬件加速器虚拟化有效

专利信息
申请号: 201380079813.8 申请日: 2013-09-24
公开(公告)号: CN105579959B 公开(公告)日: 2019-06-07
发明(设计)人: 汪伟;M·保利克;J·帕里 申请(专利权)人: 渥太华大学
主分类号: G06F9/455 分类号: G06F9/455;G06F13/28;G06F15/167
代理公司: 北京市铸成律师事务所 11313 代理人: 郝文博
地址: 加拿大,*** 国省代码: 加拿大;CA
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摘要: 一般提供了虚拟化硬件加速的技术。在一些示例中,协同监管器组件可被配置为多路复用多个域的请求以在半虚拟化环境中访问诸如现场可编程门阵列(FPGA)、专用集成电路(ASIC)或相当的加速器的硬件加速器。超请求可用于硬件加速虚拟化,其中硬件加速模块同时加载对第一加速器应用的请求的数据的一部分和对第二加速器应用的另一请求的数据的一部分并且同时处理两个部分的数据。直接位于设备驱动器层上,协同监管器可以通过直接存储器访问(DMA)上下文切换来安排同时对硬件加速器的访问请求的部分。
搜索关键词: 硬件 加速器 虚拟
【主权项】:
1.一种访问系统中的虚拟化硬件加速模块的方法,所述系统具有在虚拟机管理器内执行的协同监管器,其中所述虚拟化硬件加速模块为现场可编程门阵列或专用集成电路,所述方法包括:识别来自第一虚拟机的对能在所述虚拟化硬件加速模块上执行的第一加速器应用的第一访问请求;识别来自第二虚拟机的对能在所述虚拟化硬件加速模块上执行的第二加速器应用的第二访问请求;利用协同监管器来安排所述第一访问请求和所述第二访问请求;以及通过所述协同监管器使所述虚拟化硬件加速模块分别执行所述第一加速器应用和所述第二加速器应用来使所述虚拟化硬件加速模块同时处理所述第一访问请求的至少一部分和所述第二访问请求的至少一部分,其中:在读操作阶段经由所述虚拟化硬件加速模块的读信道执行所述第一加速器应用和所述第二加速器应用的每一个,以及在写操作阶段经由所述虚拟化硬件加速模块的写信道执行所述第一加速器应用和所述第二加速器应用的每一个,其中所述读信道一次执行一个单独的读操作阶段,所述写信道一次执行一个单独的写操作阶段,以及同时处理所述第一访问请求的至少一部分和所述第二访问请求的至少一部分包括:当所述读信道处于空闲状态时,对于所述第一访问请求的所述一部分通过所述协同监管器开始所述第一加速器应用的所述读操作阶段;接收来自所述虚拟化硬件加速模块的第一中断,指示所述第一加速器应用的所述读操作阶段已经结束并且所述读信道已恢复到空闲状态;响应于所述第一中断,通过所述协同监管器开始所述第一加速器应用的所述写操作阶段,并且所述写信道处于空闲状态,同时开始对所述第二访问请求的所述第二加速器应用的所述读操作阶段,从而将所述读信道和所述写信道置于忙状态;接收来自所述虚拟化硬件加速模块的第二中断,指示所述第一加速器应用的所述写操作阶段已经结束并且所述写信道已经返回到空闲状态;以及响应于所述第二中断,开始所述第二加速器应用的所述写操作阶段。
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