[发明专利]一种超前-滞后型数字鉴相器结构有效
| 申请号： | 201410125766.2 | 申请日： | 2014-03-31 |
| 公开（公告）号： | CN104954014B | 公开（公告）日： | 2019-04-23 |
| 发明（设计）人： | 黑勇;韩越;乔树山 | 申请（专利权）人： | 中国科学院微电子研究所 |
| 主分类号： | H03L7/18 | 分类号： | H03L7/18 |
| 代理公司： | 北京汉昊知识产权代理事务所(普通合伙) 11370 | 代理人： | 朱海波 |
| 地址： | 100029 *** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供了一种超前‑滞后型数字鉴相器结构，由第一信号通路、第二信号通路组成和三输入与非门组成；其中，所述第一信号通路包括：第一D触发器、第一反相器、第一缓冲器、第一与非门、第一数字脉冲放大器以及第三D触发器；其中，所述第二信号通路包括：第二D触发器、第二反相器、第二缓冲器、第二与非门、第二数字脉冲放大器以及第四D触发器其中，三输入与非门的第三输入端连接输入使能信号，输出端连接第一、第二D触发器的复位端。本发明通过适当增加一些逻辑单元和触发器，增加了触发信号的有效时间，可以大幅提高超前‑滞后型的鉴相精度。 | ||
| 搜索关键词： | 滞后型 缓冲器 放大器 三输入与非门 数字鉴相器 第二信号 数字脉冲 反相器 与非门 超前 输出端连接 输入端连接 触发信号 逻辑单元 使能信号 触发器 复位端 鉴相 | ||
【主权项】：
1.一种超前‑滞后型数字鉴相器，包括第一信号通路、第二信号通路和三输入与非门(NAND3)；其中，所述第一信号通路包括：第一D触发器(DFF1)、第一反相器(INV1)、第一缓冲器(BUF1)、第一与非门(NAND1)、第一数字脉冲放大器以及第三D触发器(DFF3)；所述第二信号通路包括：第二D触发器(DFF2)、第二反相器(INV2)、第二缓冲器(BUF2)、第二与非门(NAND2)、第二数字脉冲放大器以及第四D触发器(DFF4)；所述第一D触发器(DFF1)的输出分别连接三输入与非门(NAND3)的第一输入端、第一反相器(INV1)和第一与非门(NAND1)的输入端；第一缓冲器(BUF1)的输出端连接第二与非门(NAND2)的输入端；第一数字脉冲放大器的输入端连接第一与非门(NAND1)的输出端，第一数字脉冲放大器的输出端连接第三D触发器(DFF3)的输入端；所述第二D触发器(DFF2)的输出分别连接三输入与非门(NAND3)的第二输入端、第二反相器(INV2)和第二与非门(NAND2)的输入端；第二缓冲器(BUF1)的输出端连接第一与非门(NAND1)的输入端；第二数字脉冲放大器的输入端连接第二与非门(NAND2)的输出端，第二数字脉冲放大器的输出端连接第四D触发器(DFF4)的输入端；其中，三输入与非门(NAND3)的第三输入端连接输入使能信号(enable)，输出端连接第一D触发器(DFF1)和第二D触发器(DFF2)的复位端。
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