[发明专利]处理器中的移动平均处理及处理器无效

专利信息
申请号: 201410177617.0 申请日: 2014-04-29
公开(公告)号: CN104182207A 公开(公告)日: 2014-12-03
发明(设计)人: 伊藤真纪子;久保田学;野元一宏 申请(专利权)人: 富士通株式会社
主分类号: G06F9/38 分类号: G06F9/38
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 康建峰;李春晖
地址: 日本神*** 国省代码: 日本;JP
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摘要: 本公开涉及处理器中的移动平均处理及处理器。一种并行地执行m个算术运算的处理器,其执行将输入数据序列的第i个元素至第(i+m-1)个元素作为输入元素的部分和指令以获得第一向量数据;执行将输入数据序列的第(i+x)个元素至第(i+x+m-1)个元素作为输入元素的部分和指令以获得第二向量数据;以及对于第0元素至第(m-1)个元素中的每个元素并行地执行从输入数据序列的第i个元素至第(i+x-1)个元素的和中减去第一向量数据的第p个元素以及加上第二向量数据的第p个元素的运算,以并行地计算彼此不同的m个部段的元素的和;以及执行移动平均处理以根据部段的元素的和来计算移动平均。
搜索关键词: 处理器 中的 移动 平均 处理
【主权项】:
一种处理器,包括:处理单元,所述处理单元并行地执行m个算术运算,m是2或更大的整数,以及所述处理单元基于第0个输入元素至第(m‑1)个输入元素来执行计算所述第0个输入元素至第p个输入元素的和并且返回所述每个和作为第p个结果元素的部分和指令,p是0至m‑1的整数,其中,所述处理单元执行移动平均处理,所述移动平均处理包括:执行将输入数据序列的第i个元素至第(i+m‑1)个元素作为所述第0个输入元素至所述第(m‑1)个输入元素的所述部分和指令以获得第一向量数据,i是0和自然数之中的任意数;执行将所述输入数据序列的第(i+x)个元素至第(i+x+m‑1)个元素作为所述第0个输入元素至所述第(m‑1)个输入元素的所述部分和指令以获得第二向量数据,x是自然数;对于所述第0个元素至所述第(m‑1)个元素中的每个元素并行地执行从所述输入数据序列的第i个元素至第(i+x‑1)个元素的和中减去所述第一向量数据的第p个元素以及加上所述第二向量数据的第p个元素的运算,以并行地计算彼此不同的m个部段的元素的和;以及根据所计算的所述部段的元素的和来计算所述输入数据序列的移动平均。
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