[发明专利]一种中央处理器及其指令处理方法有效
| 申请号： | 201410276522.4 | 申请日： | 2014-06-19 |
| 公开（公告）号： | CN104020981B | 公开（公告）日： | 2017-10-10 |
| 发明（设计）人： | 张莹;郝晓东 | 申请（专利权）人： | 大唐微电子技术有限公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30;G06F9/44 |
| 代理公司： | 北京安信方达知识产权代理有限公司11262 | 代理人： | 李红爽,栗若木 |
| 地址： | 100094*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供一种CPU及其指令处理方法，该CPU包括指令缓冲选择器；两个指令缓冲单元；译码单元用于根据所译码的指令生成指令预判信号；指令预判信号用于指示下一次执行单元是否要执行跳转指令；指令缓冲选择器用于当接收到的所述指令预判信号指示下一次执行单元要执行跳转指令时，从当前选择的指令缓冲单元切换到另一个缓冲指令单元，控制切换到的缓冲指令单元从所述跳转指令所指向的程序存储器的位置开始读取指令并保存；当发生跳转时，从切换到的缓冲指令单元读取指令发送给译码单元；当跳转指令的执行结果是不跳转时，切换回切换前所选择的缓冲指令单元继续读取指令。本发明能够使原CPU在不增大面积的基础上使CPU的内核速度提升25％。 | ||
| 搜索关键词： | 一种 中央处理器 及其 指令 处理 方法 | ||
【主权项】：
一种中央处理器，具体包括：传统16位CPU，包括：译码单元、执行单元，指令缓冲单元；其特征在于，还包括：指令缓冲选择器；所述指令缓冲单元为两个；所述译码单元用于根据所译码的指令生成指令预判信号；所述指令预判信号用于指示下一次执行单元是否要执行跳转指令；所述指令缓冲选择器用于当接收到的所述指令预判信号指示下一次执行单元要执行跳转指令时，从当前选择的指令缓冲单元切换到另一个缓冲指令单元，控制切换到的缓冲指令单元从所述跳转指令所指向的程序存储器的位置开始读取指令并保存；当发生跳转时，从切换到的缓冲指令单元读取指令发送给所述译码单元；当所述跳转指令的执行结果是不跳转时，切换回切换前所选择的缓冲指令单元继续读取指令；当所述跳转指令的执行结果是不跳转时，所述指令缓冲选择器还用于向所述切换到的缓冲指令单元发送跳转无效信号，所述切换到的缓冲指令单元在接收到所述指令缓冲选择器的跳转无效信号后清空所存储的指令；还包括：一位累加器，用于对所述执行单元执行所述跳转指令的跳转有效信号进行累加，并将累加结果发送给所述指令缓冲选择器；所述指令缓冲选择器根据所述累加结果，在发生跳转时选中不同的指令缓冲单元，从选中的指令缓冲单元读取指令发送给所述译码单元。
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