[发明专利]静电放电(ESD)电路有效

专利信息
申请号: 201410502914.8 申请日: 2014-09-26
公开(公告)号: CN104517957B 公开(公告)日: 2018-03-27
发明(设计)人: 布鲁斯·J·特施 申请(专利权)人: Qorvo美国公司
主分类号: H01L27/02 分类号: H01L27/02
代理公司: 北京集佳知识产权代理有限公司11227 代理人: 王萍,陈炜
地址: 美国北卡*** 国省代码: 暂无信息
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摘要: 本公开内容的实施方式描述静电放电(ESD)电路以及相关联的技术和配置。在一种实施方式中,ESD电路包括与电源电压节点和接地节点耦接的第一节点;与第一节点和电源电压节点耦接的第一晶体管;与第一节点和接地节点耦接的第二晶体管;与第一晶体管和第二晶体管耦接的第二节点;与第二节点耦接的第三晶体管;以及与第三晶体管耦接的第三节点,其中,用于对第一节点充电的第一时间段小于用于对第三节点放电的第二时间段。可以描述和/或要求保护其他实施方式。
搜索关键词: 静电 放电 esd 电路
【主权项】:
一种静电放电(ESD)电路,包括:与电源电压节点和接地节点耦接的第一节点;与所述第一节点和所述电源电压节点耦接的第一晶体管;与所述第一节点和所述接地节点耦接的第二晶体管;与所述第一晶体管和所述第二晶体管耦接的第二节点;与所述第二节点耦接的第三晶体管;与所述第三晶体管耦接的第三节点,其中,用于对所述第一节点充电的第一时间段小于用于对所述第三节点放电的第二时间段;以及与所述第三节点耦接的第四晶体管,其中,用于对所述第三节点放电的所述第二时间段在所述第三晶体管被设置为关断状态时开始,并且在所述第四晶体管被设置为导通状态时结束。
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