[发明专利]一种用于分布式综合接入系统的新型FPGA模块有效
| 申请号： | 201410840911.5 | 申请日： | 2014-12-29 |
| 公开（公告）号： | CN104581782B | 公开（公告）日： | 2018-01-19 |
| 发明（设计）人： | 朱哲科;金淮东;尹文丰 | 申请（专利权）人： | 三维通信股份有限公司 |
| 主分类号： | H04W24/02 | 分类号： | H04W24/02 |
| 代理公司： | 杭州九洲专利事务所有限公司33101 | 代理人： | 陈继亮 |
| 地址： | 310053 浙江省杭州市*** | 国省代码： | 浙江;33 |
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| 摘要： | 本发明提供一种用于分布式综合接入系统的新型FPGA模块，所述FPGA模块包括转换检测模块101、调度模块102和存储转发模块103；其中，转换检测模块101包括格式转换子模块101a、格式逆转换子模块101b、长短包检测子模块101c、错包检测与删除子模块101d、MAC地址冲突检测子模块101e、整包转发及接收子模块101f；存储转发模块103包括整帧存储转发子模块103a、解帧子模块103b和组帧子模块103c。本发明有益的效果所述FPGA模块实现了在iDAS系统中级联多个RU设备情况下，软件快速升级；同时具有较大容量、低延时以及无误差的特性，提高了设备访问的迅捷与安全性。 | ||
| 搜索关键词： | 一种 用于 分布式 综合 接入 系统 新型 fpga 模块 | ||
【主权项】：
一种用于分布式综合接入系统的新型FPGA模块，其特征在于：所述FPGA模块包括：转换检测模块(101)、调度模块(102)和存储转发模块(103)，所述转换检测模块(101)包括：格式转换子模块(101a)、格式逆转换子模块(101b)、长短包检测子模块(101c)、错包检测与删除子模块(101d)、MAC地址冲突检测子模块(101e)、整包转发及接收子模块(101f)；所述调度模块(102)采用轮询的算法，使iDAS系统实现通信信息的上报以及下发；所述存储转发模块(103)包括整帧存储转发子模块(103a)、解帧子模块(103b)和组帧子模块(103c)，其中整帧存储转发子模块(103a)用于将整帧以太网数据发送给调度模块(102)；解帧子模块(103b)用于将以太网数据从CPRI协议帧中的控制字位置解析出来；组帧子模块(103c)将以太网数据根据CPRI协议插入到控制字位置；所述格式转换子模块(101a)和格式逆转换子模块(101b)用于将iDAS系统中的以太网数据进行重新组帧与解帧，以降低iDAS系统的传输带宽；所述长短包检测子模块(101c)和错包检测子模块(101d)用于将检测系统中传输的错包以及将错包删除，增强了iDAS系统的以太网传输稳定性；所述MAC地址冲突检测子模块(101e)用于避免将iDAS系统以太网的传输崩溃；所述整包转发及接收子模块(101f)为过渡模块，用于转换检测模块(101)、调度模块(102)和存储转发模块(103)之间的互相访问。
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