[实用新型]一种平方根计算电路有效
| 申请号： | 201420438128.1 | 申请日： | 2014-08-01 |
| 公开（公告）号： | CN204288202U | 公开（公告）日： | 2015-04-22 |
| 发明（设计）人： | 李文忠 | 申请（专利权）人： | 李文忠 |
| 主分类号： | G06F7/552 | 分类号： | G06F7/552 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518002 广东省*** | 国省代码： | 广东;44 |
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| 摘要： | 本专利公开了一种平方根计算电路，其由减法器、移位寄存器、计数器、比较器、锁存器及其它一些电路组成。 | ||
| 搜索关键词： | 一种 平方根 计算 电路 | ||
【主权项】：
一种平方根计算电路，其特征在于，包括：输入锁存：所述输入锁存用于缓存待开平方二进制数；输出锁存：所述输出锁存用于缓存平方根；第一移位寄存器：所述第一移位寄存器用于在计数器控制下将待开平方二进制数每次左移两位到第一数据合成器；第二移位寄存器：所述第二移位寄存器用于将输出锁存中的数左移指定位数提供给比较器及第二数据合成器；计数器：所述计数器I、计数器II及计数器III分别用于控制第一移位寄存器、0/1掩码电路及第二移位寄存器的操作；减法器：所述减法器用于将合成数锁存器中的数与第二数据合成器送来的数进行减法运算；余数锁存器：所述余数锁存器用于缓存减法器运算的结果；比较器：所述比较器用于对合成数锁存器中的数据与第二移位寄存器输出的数据进行比较运算；0/1掩膜电路：所述0/1掩码电路根据比较器的输出生成0或1作为每次产生的平方根的位；第一数据合成器：所述第一数据合成器用于将余数锁存器中的数据与第一移位寄存器输出的结果进行合成；第二数据合成器：所述第二数据合成器用于将第二移位寄存器输出的结果的末位前插入一位0；合成数锁存器：所述合成数锁存器用于缓存第一数据合成器的运算结果；计数控制器：所述计数控制器用于根据所需要计算的位数控制各计数器。
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