[实用新型]A/D同时采样结构电路有效
| 申请号： | 201420602466.4 | 申请日： | 2014-10-17 |
| 公开（公告）号： | CN204119213U | 公开（公告）日： | 2015-01-21 |
| 发明（设计）人： | 马健 | 申请（专利权）人： | 保定市安科电气有限公司 |
| 主分类号： | H03M1/54 | 分类号： | H03M1/54 |
| 代理公司： | 北京市商泰律师事务所 11255 | 代理人： | 毛燕生 |
| 地址： | 071051 河北*** | 国省代码： | 河北;13 |
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| 摘要： | 一种A/D同时采样结构电路，属于电器技术领域。芯片是八选一模拟门电路，芯片的16Vcc连接+5V再经过电容接地；芯片的16Vcc端口连接+5V再经过电容C7接地；V0连线经电阻接入芯片的IO0端口，V1连线经第一电阻接入芯片的IO1端口，V2连线经第二电阻接入芯片的IO2端口，V3连线经第三电阻接入芯片的IO3端口，V4连线经第四电阻接入芯片的IO4端口，V5连线经第五电阻接入芯片的IO5端口，V6连线经第六电阻接入芯片的IO6端口，V7连线经第七电阻接入芯片的IO7端口。本实用新型采用A/D同时采样结构，充分发挥各个处理单元的内置A/D模块，使得采样真正实现了实时性。 | ||
| 搜索关键词： | 同时 采样 结构 电路 | ||
【主权项】：
一种A/D同时采样结构电路,其特征在于芯片是八选一模拟门电路，芯片的16Vcc连接+5V再经过电容接地；芯片的16Vcc端口连接+5V再经过电容C7接地；V0连线经电阻接入芯片的IO0端口，V1连线经第一电阻接入芯片的IO1端口，V2连线经第二电阻接入芯片的IO2端口，V3连线经第三电阻接入芯片的IO3端口，V4连线经第四电阻接入芯片的IO4端口，V5连线经第五电阻接入芯片的IO5端口，V6连线经第六电阻接入芯片的IO6端口，V7连线经第七电阻接入芯片的IO7端口；A端口、B端口、C端口为二进制数控制输入，INH端口为抑制输入，从V0连线至V7连线同时采样。
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