[发明专利]一种处理器和用于在处理器中执行分支预测的方法有效
| 申请号： | 201480065959.1 | 申请日： | 2014-10-24 |
| 公开（公告）号： | CN106030516B | 公开（公告）日： | 2019-09-03 |
| 发明（设计）人： | 道格拉斯·威廉姆斯;萨希尔·阿罗拉;尼基尔·古普塔;陈威宇;德比杰特·达斯萨尔马;马吕斯·埃弗斯 | 申请（专利权）人： | 超威半导体公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38 |
| 代理公司： | 上海胜康律师事务所 31263 | 代理人： | 樊英如;张华 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明呈现用于在处理器中执行分支预测的一种处理器、一种设备和一种非暂时性计算机可读介质。所述处理器包括前端单元。所述前端单元包括1级分支目标缓冲器(BTB)、BTB索引预测器(BIP)和1级散列感知器(HP)。所述BTB被配置来预测目标地址。所述BIP被配置来基于程序计数器和全局历史产生预测，其中所述预测包括推测性部分目标地址、全局历史值、全局历史移位值和路径预测。所述HP被配置来预测分支指令是取用还是不取用。 | ||
| 搜索关键词： | 分支 预测 单元 指令 高速缓存 中的 带宽 增加 | ||
【主权项】：
1.一种处理器，其包括：前端单元，其包括：1级分支目标缓冲器，其被配置来预测目标地址；分支目标缓冲器索引预测器，其被配置来基于程序计数器和全局历史产生预测，其中所述预测包括推测性部分目标地址、全局历史值、全局历史移位值和路径预测；和1级散列感知器，其被配置来预测分支指令是取用还是不取用，第一比较器，其被配置来将来自所述分支目标缓冲器索引预测器的所述推测性部分目标地址和来自所述1级分支目标缓冲器的所述目标地址相比较；全局历史移位器，其被配置来基于来自所述1级散列感知器的取用/不取用预测产生全局历史移位值；第二比较器，其被配置来将来自所述分支目标缓冲器索引预测器的所述全局历史移位值与来自所述全局历史移位器的所述全局历史移位值相比较；和逻辑门，其被配置来基于所述第一比较器的输出和所述第二比较器的输出产生匹配信号，其中所述匹配信号指示所述分支目标缓冲器索引预测器是否作出正确预测。
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