[发明专利]用于仿真共享内存架构中的长延迟操作的架构有效
| 申请号： | 201480070278.4 | 申请日： | 2014-12-16 |
| 公开（公告）号： | CN106030517B | 公开（公告）日： | 2020-02-28 |
| 发明（设计）人： | 马尔蒂·佛塞尔 | 申请（专利权）人： | 芬兰国家技术研究中心股份公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38 |
| 代理公司： | 成都超凡明远知识产权代理有限公司 51258 | 代理人： | 魏彦 |
| 地址： | 芬兰*** | 国省代码： | 暂无信息 |
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| 摘要： | 用于仿真共享内存(ESM)架构的处理器架构布置，包括若干多线程处理器，优选地多个多线程处理器，每个多线程处理器设置有交错的线程间流水线，其中流水线包括多个串联布置的用于对数据执行算数、逻辑以及可选地其它操作的多个功能单元，其中较低延迟的一个或多个功能单元被放置在所述流水线中位于内存访问区段之前，并且用于执行与较长延迟相关联的较复杂操作的一个或多个长延迟单元(LLU)被放置成操作上与内存访问区段并行。在一些实施方案中，流水线可以包含与内存访问区段并行的多个分支，每个分支包含至少一个长延迟单元。 | ||
| 搜索关键词： | 用于 仿真 共享 内存 架构 中的 延迟 操作 | ||
【主权项】：
一种用于仿真共享内存(ESM)架构的处理器架构布置，包括：若干个多线程处理器，优选地多个多线程处理器，每个多线程处理器设置有交错的线程间流水线(400、500)，其中所述流水线(400、500)包括多个串联布置的用于对数据执行算数、逻辑以及可选地其它操作的多个功能单元(402、402b、402c、502a)，其中较低延迟的一个或多个功能单元(402)被放置在所述流水线中位于内存访问区段(412)之前，并且用于执行与较长延迟相关联的较复杂操作的一个或多个长延迟单元(402b、502a)被放置为操作上与所述内存访问区段(412)并行。
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