[发明专利]在最佳频率处理较慢的扫描输出有效
| 申请号： | 201480071759.7 | 申请日： | 2014-12-31 |
| 公开（公告）号： | CN105874343B | 公开（公告）日： | 2019-05-14 |
| 发明（设计）人： | R·K·米塔尔;M·S·卡乌萨;S·N·波蒂 | 申请（专利权）人： | 德克萨斯仪器股份有限公司 |
| 主分类号： | G01R31/28 | 分类号： | G01R31/28 |
| 代理公司： | 北京纪凯知识产权代理有限公司 11245 | 代理人： | 赵志刚;赵蓉民 |
| 地址： | 美国德*** | 国省代码： | 美国;US |
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| 摘要： | 在描述的用于测试集成电路的电路(200)的示例中，电路(200)包括由扫描时钟(230)驱动的扫描压缩体系结构(205)并生成M个扫描输出(220)，其中M为整数。时钟分频器(232)被配置为将扫描时钟(230)除以k，以生成k个数量的相移扫描时钟，其中k为整数。打包逻辑(222)耦接到扫描压缩体系结构(205)并响应于M个扫描输出(220)和k个相移扫描时钟生成kM个慢扫描输出(224)。打包逻辑(222)进一步包括M个数量的打包元件，并且M个打包元件中的每个接收M个扫描输出(220)中的相应一个扫描输出(220)。每个打包元件包括k个数量的触发器，并且打包元件中的k个触发器中的每个接收M扫描输出(220)中的相应一个扫描输出(220)。每个触发器接收k个相移扫描时钟中的相应一个相移扫描时钟，致使响应于扫描输出和相移扫描时钟，每个触发器生成kM个慢扫描输出中的相应一个慢扫描输出。 | ||
| 搜索关键词： | 最佳 频率 处理 扫描 输出 | ||
【主权项】：
1.一种电路，所述电路包括：扫描压缩体系结构，所述扫描压缩体系结构由扫描时钟驱动，并且被配置为生成M个扫描输出，其中M为整数；时钟分频器，所述时钟分频器被配置将所述扫描时钟除以k，以生成k个数量的相移扫描时钟，其中k为整数；和打包逻辑，所述打包逻辑耦接到所述扫描压缩体系结构，并且被配置为响应于所述M个扫描输出和所述k个数量的相移扫描时钟，生成kM个慢扫描输出；其中，所述打包逻辑包括：M个数量的打包元件，所述M个数量的打包元件的每个打包元件被配置为接收所述M个扫描输出中的扫描输出；以及每个打包元件中的k个数量的触发器，打包元件中的所述k个数量的触发器的每个触发器被配置为接收所述M个扫描输出中的扫描输出，并且被配置为接收所述k个数量的相移扫描时钟中的相移扫描时钟，致使每个触发器响应于所述扫描输出和所述相移扫描时钟，生成所述kM个慢扫描输出中的慢扫描输出。
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