[发明专利]接收机电路和在接收机电路上操作的方法有效

专利信息
申请号: 201480076817.5 申请日: 2014-11-12
公开(公告)号: CN106063181B 公开(公告)日: 2018-03-13
发明(设计)人: S·森戈库;G·A·威利;C·李 申请(专利权)人: 高通股份有限公司
主分类号: H04L7/033 分类号: H04L7/033;H03K5/1252;H03K5/1534;H04L25/49;H04L25/14
代理公司: 上海专利商标事务所有限公司31100 代理人: 唐杰敏
地址: 美国加利*** 国省代码: 暂无信息
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摘要: 多个线接口被配置成在该多个线接口上接收经扩展信号。该经扩展信号携带在连贯码元之间具有受保障的码元到码元状态转变的码元。该经扩展信号由包括第一线接口上的第一信号在内的多个转变信号来定义。时钟信号基于第一信号的第一实例与第一信号的经延迟的第二实例之间的比较来提取。第一信号的经延迟的第二实例基于该时钟信号来被采样以提供码元输出。时钟提取电路被进一步适配成基于该多个转变信号内第二信号的第一实例与第二信号的经延迟的第二实例之间的附加比较来生成该时钟信号,并且第一信号和第二信号是在不同的线接口上接收到的并发信号。
搜索关键词: 用于 数据 信号 时钟 恢复 电路
【主权项】:
一种接收机电路,包括:多个线接口,其配置成接收分布在所述多个线接口上的经扩展信号,所述经扩展信号携带在连贯码元之间具有受保障的码元到码元状态转变的码元,所述经扩展信号由包括第一线接口上的第一信号和第二线接口上的第二信号在内的多个状态转变信号来定义;时钟提取电路,其适配成基于所述第一信号的第一实例与所述第一信号的经延迟的第二实例之间的比较以及所述第二信号的第一实例与所述第二信号的经延迟的第二实例的比较来获得时钟信号;以及负保持时间逻辑电路,其适配成基于所述时钟信号来对所述第一信号的所述经延迟的第二实例进行采样并且提供码元输出。
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