[发明专利]寄存器输入输出互换的抗故障注入攻击方法和装置有效
申请号: | 201510094757.6 | 申请日: | 2015-03-03 |
公开(公告)号: | CN104700044B | 公开(公告)日: | 2017-10-24 |
发明(设计)人: | 刘雷波;王博;朱敏;周卓泉;尹首一;魏少军 | 申请(专利权)人: | 清华大学 |
主分类号: | G06F21/76 | 分类号: | G06F21/76 |
代理公司: | 北京清亦华知识产权代理事务所(普通合伙)11201 | 代理人: | 张大威 |
地址: | 100084 北京*** | 国省代码: | 北京;11 |
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摘要: | 本发明公开了一种寄存器输入输出互换的抗故障注入攻击方法和装置,寄存器输入输出互换的抗故障注入攻击方法包括S1,获取目标集成电路上能运行的第一最大数据宽度;S2,根据第一最大数据宽度获取目标集成电路上运行加密算法时需要的第二最大数据宽度;S3,根据第二最大数据宽度对需要进行输入输出互换的多个寄存器进行分组;S4,对每组的多个寄存器处电路进行改造;S5,确定每组的多个寄存器处电路进行数据选择的控制数;S6,根据控制数确定每组的多个寄存器处电路的数据选择规则。本发明能够使得存储加密算法数据的寄存器不再固定,降低了故障成功注入到电路中的几率,提高了电路的安全性。 | ||
搜索关键词: | 寄存器 输入输出 互换 故障 注入 攻击 方法 装置 | ||
【主权项】:
一种寄存器输入输出互换的抗故障注入攻击方法,其特征在于,包括以下步骤:S1,根据目标集成电路的计算阵列规模和所述计算阵列的互联模式,获取所述目标集成电路上能运行的第一最大数据宽度,其中,所述计算阵列包括多个基本计算单元PE,所述PE包括与算术逻辑单元ALU相连的多个多路选择器MUX和与所述ALU相连的寄存器;S2,根据所述第一最大数据宽度,获取所述目标集成电路上运行加密算法时需要的第二最大数据宽度;S3,根据所述第二最大数据宽度对需要进行输入输出互换的多个寄存器进行分组;S4,对每组的多个寄存器处电路进行改造,其中,改造后的电路中每个所述寄存器的输入端和输出端分别与输入多路选择器IN_MUX和输出多路选择器OUT_MUX相连;S5,确定每组的多个寄存器处电路对应的多个所述IN_MUX和多个所述OUT_MUX进行数据选择的控制数;以及S6,根据所述控制数确定每组的多个寄存器处电路对应的多个所述IN_MUX和多个所述OUT_MUX的数据选择规则。
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