[发明专利]半导体结构的形成方法有效
申请号: | 201510271980.3 | 申请日: | 2015-05-25 |
公开(公告)号: | CN106298667B | 公开(公告)日: | 2019-03-29 |
发明(设计)人: | 胡华勇;林益世;宋伟基 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/8238 | 分类号: | H01L21/8238 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 应战;吴敏 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种半导体结构的形成方法,包括:在高K介质层以及第一凹槽、第二凹槽和第三凹槽的侧壁表面上形成第一金属层;在第一金属层上形成第二金属层;在第二金属层上形成无机填充层,无机填充层填充满第一凹槽、第二凹槽和第三凹槽,且第二区域的无机填充层的厚度大于第一区域的无机填充层的厚度;在所述无机填充层上形成可回流的有机涂层,第二区域的可回流的有机涂层的厚度小于第一区域的可回流的有机涂层的厚度;刻蚀去除第二区域和第一区域内的NMOS区上的可回流的有机涂层、无机填充层和第二金属层,暴露出第一金属层的表面。本发明的方法防止采用单一无机填充层带来的厚度差异并导致的不同区域的金属层的刻蚀损伤。 | ||
搜索关键词: | 半导体 结构 形成 方法 | ||
【主权项】:
1.一种半导体结构的形成方法,其特征在于,包括:提供半导体衬底,所述半导体衬底包括第一区域和第二区域,所述第一区域包括NMOS区和PMOS区,PMOS区的半导体衬底上具有若干第一伪栅,NMOS区的半导体衬底上具有若干第二伪栅,第二区域的半导体衬底上具有若干第三伪栅,所述第一伪栅和第二伪栅的密度大于第三伪栅的密度,所述第一伪栅、第二伪栅以及第三伪栅与半导体衬底之间具有高K介质层,所述第一伪栅和第二伪栅的密度为单位面积内第一伪栅和第二伪栅的数量,所述第三伪栅的密度为单位面积内第三伪栅的数量;形成覆盖所述半导体衬底、第一伪栅、第二伪栅和第三伪栅的介质层,所述介质层的表面与第一伪栅、第二伪栅和第三伪栅的顶部表面齐平;去除所述第一伪栅、第二伪栅和第三伪栅,形成第一凹槽、第二凹槽和第三凹槽;在所述高K介质层上以及第一凹槽、第二凹槽和第三凹槽的侧壁表面上形成第一金属层;在所述第一金属层上形成第二金属层;在第二金属层上形成无机填充层,无机填充层填充满第一凹槽、第二凹槽和第三凹槽,且第二区域的无机填充层的厚度大于第一区域的无机填充层的厚度;在所述无机填充层上形成可回流的有机涂层,第二区域的可回流的有机涂层的厚度小于第一区域的可回流的有机涂层的厚度,所述可回流的有机涂层用于消除无机填充层的第一区域和第二区域上的厚度差异,使得无机填充层和可回流的有机涂层构成的整体结构具有平坦的表面;在所述可回流的有机涂层上形成图形化的光刻胶层,所述图形化的光刻胶层暴露出第二区域和第一区域内的NMOS区的可回流的有机涂层表面;刻蚀去除第二区域和第一区域内的NMOS区上的可回流的有机涂层、无机填充层和第二金属层,暴露出第一金属层的表面。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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