[发明专利]多模分频器及通信方法有效

专利信息
申请号: 201510272673.7 申请日: 2015-05-26
公开(公告)号: CN105322952B 公开(公告)日: 2018-10-16
发明(设计)人: 哈维尔·毛里西奥·贝兰迪亚托雷斯 申请(专利权)人: 恩智浦有限公司
主分类号: H03K23/00 分类号: H03K23/00
代理公司: 中科专利商标代理有限责任公司 11021 代理人: 杨静
地址: 荷兰艾*** 国省代码: 荷兰;NL
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摘要: 一种分频电路,可以实现多模操作。所述分频电路包括时钟晶体管器件、存储器晶体管电路、写入晶体管器件和电流源偏置。时钟晶体管器件在分频器的输入处接收具有第一频率的差分输入信号。存储器晶体管电路基于来自时钟晶体管器件的差分输入信号,存储信号。写入晶体管器件使得输出端子处的已分频信号可用。电流源偏置被耦接到时钟晶体管器件。电流源偏置施加偏置电流以使分频器适配于分频器输入处的共模。
搜索关键词: 分频器
【主权项】:
1.一种分频器,包括:主分频器,包括:时钟晶体管器件,用于在分频器的输入处接收具有第一频率的差分输入信号;存储器晶体管电路,耦接到所述时钟晶体管器件,以便基于来自时钟晶体管器件的差分输入信号来存储信号;写入晶体管器件,耦接到所述存储器晶体管电路,以使主分频器的多个输出端子处的第一已分频信号可用;以及电流源偏置,耦接到所述时钟晶体管器件,其中所述电流源偏置被配置为施加偏置电流以使分频器适配于分频器的输入处的共模;从分频器,包括:从时钟晶体管器件,用于接收差分输入信号;从存储器晶体管电路,耦接到所述从时钟晶体管器件;从写入晶体管器件,耦接到所述从存储器晶体管电路,以使从分频器的多个输出端子处的第二已分频信号可用;串联开关,用于通过基于主分频器的输出端的状态控制何时自从分频器输出从分频器的各个写入周期来控制从写入晶体管器件的操作;从电流源偏置,耦接到所述从时钟晶体管器件,其中所述从电流源偏置被配置为施加从偏置电流。
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