[发明专利]对脉冲边沿信号具有检测、计数和验证功能的电路有效

专利信息
申请号: 201510319251.0 申请日: 2015-06-11
公开(公告)号: CN104883160B 公开(公告)日: 2017-11-03
发明(设计)人: 曹春 申请(专利权)人: 天津大学
主分类号: H03K5/1534 分类号: H03K5/1534;H03K23/00
代理公司: 天津市北洋有限责任专利代理事务所12201 代理人: 李丽萍
地址: 300072*** 国省代码: 天津;12
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摘要: 发明公开了一种对脉冲边沿信号具有检测、计数和验证功能的电路,包括2个触发器、3组锁存器、4个加法器、2个与门、1个异或门和1个比较器;本发明电路通过检测可以判断该边沿信号是上升沿脉冲或者下降沿脉冲,并且可以针对上升沿和下降沿的出现次数分别进行计数,为了判断该电路对两个脉冲边沿的计数是否正确,该电路还增加了对双边沿脉冲的检测,当上升沿脉冲计数的数值与下降沿脉冲计数的数值之和等于双边沿脉冲计数的数值时,则说明上升沿和下降沿的计数数值都是正确,否则说明计数发生错误。实现了对采样数据的信号提取、处理和验证,提高了数据分析的可靠性和准确性,该电路原理简单,易于制作,有着极大的优势。
搜索关键词: 脉冲 边沿 信号 具有 检测 计数 验证 功能 电路
【主权项】:
一种对脉冲边沿信号具有检测、计数和验证功能的电路,其特征在于,该电路包括2个触发器、3组锁存器、4个加法器、2个与门、1个异或门和1个比较器;其中,2个触发器包括第一触发器和第二触发器,3组锁存器包括第一锁存器组、第二锁存器组和第三锁存器组,每个锁存器组均分别包括3个位宽为1的锁存器;4个加法器是4个位宽为3的加法器,包括第一加法器、第二加法器、第三加法器和第四加法器;2个与门包括第一与门和第二与门;第一触发器的输出端口与第二触发器的数据端口相连,将第二触发器的输出的取反和第一触发器输出作为所述的第一与门的两个输入信号,第一与门作为上升沿脉冲的检测门电路;将第一触发器输出的取反和第二触发器输出作为所述的第二与门的两个输入信号,第二与门作为下降沿脉冲的检测门电路;将第一触发器输出和第二触发器输出作为上述的异或门的两个输入信号,该异或门作为双边沿脉冲的检测门电路;所述第一与门的输出连接到第一锁存器组中3个锁存器的使能端,第一锁存器组中3个锁存器的输出端与第一加法器的位宽为3的一个输入端一一对应相连,所述第一加法器的位宽为3的输出端分别一一对应连接到第一锁存器组的3个锁存器的数据端口;所述第二与门的输出连接到第二锁存器组中3个锁存器的使能端,第二锁存器组中3个锁存器的输出端与第二加法器的位宽为3的一个输入端一一对应相连,第二加法器的位宽为3的输出端分别一一对应连接到第二锁存器组的3个锁存器的数据端口,所述异或门的输出连接到第三锁存器组中3个锁存器的使能端,第三锁存器组中3个锁存器的输出端与第三加法器的位宽为3的一个输入端一一对应相连;第三加法器的位宽为3的输出端分别一一对应连接到第三锁存器组的3个锁存器的数据端口;所述第一加法器、第二加法器和第三加法器的另一个输入均固定为1,当锁存器组使能端为高电平时,该锁存器组存储其本身数据端口的信息,当锁存器组使能端为低电平时,该锁存器组保持原值不变;所述第一锁存器组用于上升沿计数,所述第二锁存器组用于下升沿计数,所述第三锁存器组用于双边沿计数;所述第一锁存器组和所述第二锁存器组通过第四加法器进行求和,所述第四加法器的输出和所述第三锁存器组的输出均连接到所述比较器的输入端,通过比较器的输出结果验证上升沿计数值和下降沿计数值。
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